登录
首页 » VHDL » 编译实现循环码的产生,用FOR循环分别对其中的码元进行设置。...

编译实现循环码的产生,用FOR循环分别对其中的码元进行设置。...

于 2022-08-11 发布 文件大小:2.62 kB
0 137
下载积分: 2 下载次数: 1

代码说明:

编译实现循环码的产生,用FOR循环分别对其中的码元进行设置。-Implementation cycle of the compiler generated code, respectively, using FOR Cycle one of the key element of the set.

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • MP3播放器与VS1003 ATmega8的和SD卡
    这是一个版本的mp3播放器的迷你尺寸,你可以把它与AVR编程非常easy.it在这个项目这么简单,你使用的fat通过MMC的SPI总线,该总线使主从位置发送数据,然后用此主从,你可以从VS1003发送数据到你的ATmega8然后有一个非常简单的项目。
    2022-04-29 02:58:41下载
    积分:1
  • multiplication
    我感谢我能找到这个页面WAP相同的帮助。我在开始设计的VHDL的电路。
    2023-01-29 02:40:04下载
    积分:1
  • An SRAM of the source program, it is the SRAM 256kbx16bit
    一个sram的源码程序,它是256kbx16bit的sram-An SRAM of the source program, it is the SRAM 256kbx16bit
    2022-05-27 20:08:48下载
    积分:1
  • 0到255任意整数半整数分频Verilog HDL.rar
    0到255任意整数半整数分频Verilog HDL.rar-0-255 arbitrary integer half-integer frequency division Verilog HDL.rar
    2022-02-06 06:46:57下载
    积分:1
  • 实例
    说明:  FPGA 学习实例 动态时钟、面积、速度优化相关代码(Codes related to dynamic clock, area and speed optimization for learning examples of FPGA)
    2020-06-22 22:40:02下载
    积分:1
  • sha1
    利用verilog语言实现了SHA-1机密算法,具体算法与加密芯片ds28e01一致。(Using Verilog to achieve the SHA-1 secret algorithm, the specific algorithm is consistent with the encryption chip ds28e01.)
    2020-11-08 08:49:47下载
    积分:1
  • 8位大小比较器的VHDL源代码,Magnitude Comparator VHDL description of a 4...
    8位大小比较器的VHDL源代码,Magnitude Comparator VHDL description of a 4-bit magnitude comparator with expansion inputs-eight compared with the size of the VHDL source code, Magnitude Comparator VHDL description of a 4-bit magnitude comparator inputs with expansion
    2023-07-28 13:55:03下载
    积分:1
  • FPGA_实时时钟设计
    通过配置DS1302芯片来实现实时时钟的监测,我们通过通过控制2个按键来选择我们要在数码管上显示的时间,按下按键1我们来显示周几,按下按键2来显示年月日,不按显示时分秒,这样显示复合我们的数字表的显示(By configuring DS1302 chip to monitor the real-time clock, we select the time that we want to display on the digital tube by controlling 2 keys. Press key 1 to show the week, press the key 2 to show the year and month, not according to the display time, so that the display of the display of the display of our digital table.)
    2020-10-22 15:17:23下载
    积分:1
  • Writing-Testbenches-using-System-Verilog
    writing testbench in system verilog
    2011-12-11 06:02:47下载
    积分:1
  • AHB_UVC_and_AHB_IC_Verificat
    ahb uvc is an on chip communication protocol for high speed integration and low power utilities performance protocols widely used in all vip applications
    2020-10-21 12:07:24下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载