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lab1(mka)
RGB vga driver for manipulating the colours of a given image buffer. The code has beeen written in vhdl
- 2011-04-15 18:11:48下载
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lcd1602
艾米电子的液晶1602的Verilog语言程序
(Amy e-LCD 1602 of the Verilog language program)
- 2010-10-26 11:20:49下载
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异步FIFO的实现可以全面、可核查的]关键词:…
异步FIFO的实现,可综合,可验证]
keywords:almost_full,full,almost_empty,empty-The realization of asynchronous FIFO can be comprehensive, verifiable] keywords: almost_full, full, almost_empty, empty
- 2022-03-14 05:09:12下载
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EP2C5
基于FPGA/EP2c5的开发板详细例程,内容丰富,简单易懂(Development board based on more routine FPGA/EP2c5, content rich, easy to understand)
- 2020-12-06 22:59:23下载
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基于路由器的实现交叉
路由器是Noc的重要组成部分。本文实现了一个简单的Noc路由器。该路由器的主要单元包括FIFO缓冲区、路由单元、控制单元、交叉开关和仲裁单元。在这种情况下,使用XY路由算法。这里没有使用流量控制机制。仲裁器的输出决定了纵横开关的选择线。这里5到1个mux构成一个纵横制交换机。有5个仲裁单位。存在5个路由逻辑单元。每个端口都有自己的路由单元。路由单元的输出包括本地、北、南、东和西。ie输出是5位向量。此输出的第0位表示本地端口,第1位表示北,第2位表示南等。对于本地仲裁器输入,是所有5个路由单元的第0位。对于北仲裁器输入,是所有5个路由单元的第1位。对于北仲裁器输入,是第1位
- 2022-11-06 11:20:03下载
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以上是VHDL硬件描述语言写的一个简单锝路流水灯程序,希望对刚接触VHDL的朋友有一定帮助...
以上是VHDL硬件描述语言写的一个简单锝路流水灯程序,希望对刚接触VHDL的朋友有一定帮助-These are the VHDL hardware description language written in a simple flow path lights technetium procedures,刚接触VHDL want to have some friends to help
- 2023-08-06 14:45:02下载
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基于FPGA的电子时钟设计
具体设计内容计时功能:电子表的基本功能,要求用LCD显示,显示格式是时、分、秒;校时功能:用户可以更改当前时间。设置闹钟时间:用户可以设置闹钟时间,其操作过程与校时过程一样;整点报时开关:整点报时可以由用户设定为开启或关闭两种状态,当整点报时开启时,电子表会在整点时发出1秒的闹铃声(在UP3的板上用一个LED表示);闹钟功能开关:闹钟由用户设定为开启或关闭,当闹钟开关开启时,如果当前时间与设置的闹钟时间一致,发出长达10秒的闹铃声;
- 2022-11-29 04:25:04下载
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altera嵌入式设计大赛文章,车载cots设计实现
altera嵌入式设计大赛文章,车载cots设计实现-Embedded Design Contest altera article, cots Car Design
- 2022-05-20 14:21:28下载
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getCPU
获取主机CPU信息,VS2008编译通过,含详细说明(Get information on the host CPU, VS2008 compiler, containing detailed instructions)
- 2014-11-27 10:07:21下载
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forug_2016.03
说明: formality2016 userguide
- 2019-10-29 14:59:40下载
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