登录
首页 » VHDL » 基于FPGA的乐曲发生器电路设计 附含源代码(quartersii环境下运行)...

基于FPGA的乐曲发生器电路设计 附含源代码(quartersii环境下运行)...

于 2022-02-16 发布 文件大小:29.47 kB
0 209
下载积分: 2 下载次数: 1

代码说明:

基于FPGA的乐曲发生器电路设计 附含源代码(quartersii环境下运行)-FPGA-based circuit design of the music generator containing the source code is attached (quartersii environment to run)

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • verilog program for 8
    verilog program for 8-bit multiplier
    2023-07-15 11:05:03下载
    积分:1
  • 20190718
    uart implementation and documentation, this describes the basic steps in building your own uart module on verilog and programming them on an fpga device
    2020-06-21 21:40:01下载
    积分:1
  • LED测试小程序
    可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。可实现任意频率的LED点灯形式,只需改变分频次数和赋值就可以得到想要的的结果。
    2022-01-22 11:14:15下载
    积分:1
  • nIOS_VGA
    用NIOSII生成的VGA显示程序,可以在显示器上显示通讯内容
    2009-10-12 20:58:00下载
    积分:1
  • verilogUART
    verilog实现的串口实现代码,可以直接复制使用(verilog achieve serial implementation code can be copied directly use)
    2013-03-19 21:09:23下载
    积分:1
  • 利用VHDL语言实现8位到32位的双向数据转换
    利用VHDL语言实现8位到32位的双向数据转换-use VHDL 8-32 two-way data conversion
    2022-03-23 16:58:55下载
    积分:1
  • vhdl 语言实现的 8 位 crc
    在这里,我们目前使用 VHDL 的 8 位 crc 设计。循环冗余校验是讨论检测错误的通信,使用 vhdl 语言这一过程变得快速和可靠。
    2022-02-26 12:38:01下载
    积分:1
  • PS2键盘控制程序实验的内容是用EDK建一个简单的系统并加入自定义的外设(一个ps2键盘控制器) 当键盘按下时会有相应的键扫描码输出显示到PC终端...
    PS2键盘控制程序实验的内容是用EDK建一个简单的系统并加入自定义的外设(一个ps2键盘控制器) 当键盘按下时会有相应的键扫描码输出显示到PC终端 -PS2 keyboard to control the content of the experimental procedure is used EDK build a simple system and add custom peripherals (a ps2 keyboard controller) when the keyboard is pressed the corresponding button will scan code to the PC terminal output shows
    2022-03-26 18:34:50下载
    积分:1
  • gtx_interface_ip
    高速串行设计FPGA-GTX IP设置生成,可动态配置速率2.4Gbps,1.2Gbps,0.6Gbps,自适应链接(High-speed serial design FPGA-GTX IP settings generated dynamically configurable rate of 2.4Gbps, 1.2Gbps, 0.6Gbps, adaptive link)
    2016-09-22 09:48:00下载
    积分:1
  • AM-modulated-learning-ladder
    AM modulated learning ladder
    2015-07-15 09:42:45下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载