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decodeLogDomainSimple
When the initial input falls between the Switch off point and Switch on point values, the initial output is the value when the relay is off.
- 2017-01-29 18:04:53下载
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DDR2_XILINX
xilinx FPGA设计需要的DDR2文件,可以应用于实际设计中(xilinx FPGA design needs DDR2 files that can be applied to the actual design)
- 2014-10-09 09:54:05下载
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一个4×4矩阵键盘接口程序的Verilog设计(FPGA)
一个4*4矩阵键盘的VERILOG接口程序设计(FPGA)-A 4* 4 matrix keyboard interface program Verilog Design (FPGA)
- 2022-07-24 14:37:13下载
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seven_persons
自己写的7人表决器的verilog程序,实现4人以上通过则通过的功能。(Seven people to write their own voting machine verilog program to achieve four or more people pass through function.)
- 2013-08-10 07:15:06下载
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VHDL 基础语法篇
说明: VHDL 基础语法篇 —— VHDL
VHDL硬件描述语言
1.1 VHDL概述
1.1.1 VHDL的特点
VHDL语言作为一种标准的硬件描述语言,具有结构严谨、描述能力强的特点,由于
VHDL语言来源于C、Fortran等计算机高级语言,在VHDL语言中保留了部分高级语言的原
语句,如if语句、子程序和函数等,便于阅读和应用。具体特点如下:
1. 支持从系统级到门级电路的描述,既支持自底向上(bottom-up)的设计也支持从顶向下
(top-down)的设计,同时也支持结构、行为和数据流三种形式的混合描述。
2. VHDL的设计单元的基本组成部分是实体(entity)和结构体(architecture),实体包含设
计系统单元的输入和输出端口信息,结构体描述设计单元的组成和行为,便于各模块之间数
据传送。利用单元(componet)、块(block)、过程(procure)和函数(function)等语句,
用结构化层次化的描述方法,使复杂电路的设计更加简便。采用包的概念,便于标准设计文
档资料的保存和广泛使用。(VHDL Basic Grammar Paper)
- 2020-06-20 14:20:01下载
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MAC_TxScheduler
Ethernet MAC-MII interface of Transmit
- 2014-02-15 00:35:25下载
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LDPC码编译码算法的研究与实现_陈石平
本文首先回顾了LDPC码的发展历程和现状,介绍了LDPC码检验矩阵的构造、编
译码原理。在对编译码作了深入探讨和分析后,接着进行了RU算法编码和长码编码
的FPGA实现;根据二叉树的性质,提出了一种长码编码的ASIC优化设计的方法,节省
了大量硬件资源;论文详细阐述了CORDIC算法原理以及LDPC码译码中所采用的指
数函数和反双曲正切函数的FPGA实现:CORDIC内核及前后处理单元设计、仿真、综
合及数据分析,这对LDPC码的译码具有很重要的意义,为用数字VLSI来实现LDPC的
译码奠定了基础。同时在基于校验矩阵的环路检测定理基础上,将校验矩阵转化为转
移概率矩阵,详细分析并提出了一种基于转移概率矩阵的围长检测方法,并对其进行
了理论证明,具有很好的围长检测效果,以及状态分类判别。(Research and implementation of LDPC coding and decoding technology)
- 2018-04-08 18:49:59下载
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NIOS II IDE 编程, uart_txd测试程序,仅供参考。
NIOS II IDE 编程, uart_txd测试程序,仅供参考。-NIOS II IDE programming, uart_txd testing procedures, for information purposes only.
- 2022-11-30 03:45:03下载
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xilinx-FPGA
xilinx FPGA技术详解,从设计流程到设计注意点(xilinx FPGA technology Detailed Design points, from the design process to)
- 2012-08-10 13:07:41下载
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ethernet_100
Verilog,编写的udp收发程序,开发环境xilinx(Verilog, written UDP transceiver)
- 2020-10-29 21:09:57下载
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