-
8.8-URAT-VHDL
URAT VHDL程序与仿真 URAT the VHDL program and Simulation
(URAT the VHDL program and Simulation
)
- 2012-04-09 20:53:45下载
- 积分:1
-
产生伪的VHDL语言程序
伪随机m序列产生的VHDL语言程序- program in VHDL language for generating pseudo-random m sequence
- 2022-02-05 15:49:12下载
- 积分:1
-
ps2
PS2键盘硬件模块控制器,主要实现硬件PS2键盘的控制,适合初学verilog学者实验。(PS2 keyboard controller hardware module, the main hardware PS2 keyboard control, suitable for beginners verilog scholar experiments.)
- 2014-09-16 19:06:23下载
- 积分:1
-
vhdl source code for 8 bit datapath logic
vhdl source code for 8 bit datapath logic
- 2022-07-04 04:52:16下载
- 积分:1
-
使用Virtex-5 FPGA高级加密标准算法的高效实现
应用背景在本文中,一个高性能和高度优化Rijndael AES算法的硬件实现了设计并实现Xilinx Virtex-5 xc5vlx50FPGA器件。设计采用模块化利用VHDL语言的方法。设计工作正确如图所示。这个所提出的设计的性能进行评估的基础上吞吐量和面积。我们的设计利用了速度339.087兆赫,这意味着吞吐量4.34用399片Virtex-5 FPGA面积Gbps。关键技术本文提出了一种有效的Rijndael算法的硬件实现高级加密标准(AES)加密算法采用最先进的现场可编程门阵列(FPGA)。在非常高速集成电路设计的设计硬件描述语言(VHDL)。时序仿真进行验证所设计的电路的功能。性能评估也做了吞吐量和区域。在国家的最先进的Xilinx Virtex-5实现设计(xc5vlx50ffg676-3)FPGA实现吞吐量4.34千兆位/秒,总共使用了399片。
- 2022-02-20 11:10:20下载
- 积分:1
-
ml505_mig_design
Xilinx开发板ML505的DDRII示例程序,使用Verilog,调用MIG,编译环境ISE11.1(Xilinx ML505 development board of DDRII sample program, using Verilog, called MIG, build environment ISE11.1)
- 2010-05-13 02:39:04下载
- 积分:1
-
用VHDL语言实现CPLD(EPM240T100C5组成)串口接收程序
利用VHDL实现CPLD(EPM240T100C5)的串口接收程序-Using VHDL realize CPLD (EPM240T100C5) the serial receive procedure
- 2022-05-20 12:04:11下载
- 积分:1
-
基于VHDL的RS232通讯程序,包含完整的源代码,锁脚文件以及下载文件,可直接下载使用...
基于VHDL的RS232通讯程序,包含完整的源代码,锁脚文件以及下载文件,可直接下载使用-VHDL based on the RS232 communication procedures, including complete source code, locking pin, as well as download files documents can be directly downloaded using
- 2023-07-14 19:45:03下载
- 积分:1
-
110819_1
基于sopc的lcd时钟,开发工具为nios ii和quartus ii9.0(Based on sopc the lcd clock, development tools for the nios ii and quartus ii9.0)
- 2011-08-22 10:28:50下载
- 积分:1
-
ug948-design-files
Xilinx Sysgen User Guide
- 2018-10-14 21:54:22下载
- 积分:1