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(1)距离算法研究和设计; (2)采用FPGA/CPLD实现。

于 2022-08-13 发布 文件大小:13.33 MB
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(1)距离算法研究和设计; (2)采用FPGA/CPLD实现。 -(1) distance algorithm and design (2) using FPGA/CPLD implementation.

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  • decoder_38
    这是基于Quartus2 开发环境和verilog hdl语言写的38译码器(This is based development environment and Quartus2 verilog hdl language used to write decoder 38)
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  • cnt6
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