-
Verilog
这是个关于verilog入门的文档,有同志对verilog感兴趣,可以下载此文档,以供参考。(This is a verilog entry on the document, there are comrades of the verilog interested, you can download this document for reference.)
- 2011-11-06 13:18:07下载
- 积分:1
-
lab4
lab report for lab 4
- 2019-04-17 21:17:08下载
- 积分:1
-
Altera FIFO的多极级联,实现多个FIFO之间的数据传输。
Altera FIFO的多极级联,实现多个FIFO之间的数据传输。-Altera FIFO multi-polar cascading between multiple FIFO data transmission.
- 2022-03-17 08:34:07下载
- 积分:1
-
电子表,实现计时记分计秒的功能,同时可以对时分秒进行校正,实现调时功能。...
电子表,实现计时记分计秒的功能,同时可以对时分秒进行校正,实现调时功能。-Electronic watches, time points of dollars to achieve a second function, at the same time when the minutes and seconds can be calibrated to achieve when the transfer function.
- 2022-06-03 13:45:21下载
- 积分:1
-
FPGA
spwm dcac逆变 fpga与单片机一起作用(sdad)
- 2010-08-12 18:20:08下载
- 积分:1
-
uart vhdl代码
用于uart 的通信的vhdl代码,可以直接使用
- 2022-07-27 17:23:12下载
- 积分:1
-
VHDL程序讲解FIFO与RAM和ROM的数据交换
本资源详细的设计了一个FIFO的用法,将数据从ROM中读取送到FIFO缓存中然后RAM从FIFO缓存中读取数据存到内存中,改程序可以很好的学习三者之间的关系
- 2022-03-19 07:51:46下载
- 积分:1
-
CPU_Project_board
CPU 5级流水线实现(加hazard处理与板级验证,板级验证带有按键消抖)(5-stage pipelined CPU (plus hazard dealing with board-level verification, board-level verification with key debounce))
- 2020-12-03 09:29:25下载
- 积分:1
-
基于FPGA的1024点流水线工作方式的FFT实现,适合fpga的技术人员做信号处理参考...
基于FPGA的1024点流水线工作方式的FFT实现,适合fpga的技术人员做信号处理参考-FPGA based on the work of the 1024-point pipelined FFT approach the realization of the technical staff for doing fpga signal processing reference
- 2022-12-04 23:40:03下载
- 积分:1
-
主要是RS
主要是RS-232串行接口技术并且通过了串行收发器UART的开发实例演示了接口设计的基本步骤程序-Is RS-232 serial interface technology and, through a serial UART transceiver development of interface design examples demonstrate the basic steps of the procedure
- 2022-03-17 15:36:56下载
- 积分:1