-
用VHDL 编写的一个16位的cpu 设计方案,可以执行8条指令。
用VHDL 编写的一个16位的cpu 设计方案,可以执行8条指令。-use VHDL to prepare a 16 cpu design of the program, the implementation of eight instructions.
- 2023-07-06 05:40:03下载
- 积分:1
-
基于FPGA的数字钟
1.设计一个具有24进制计时、显示、整点报时、时间设置和闹钟功能的数字钟,要求时钟的最小分辨率时间为1s。2.多功能数字钟系统功能的具体描述如下: 计时:正常工作状态下,每日按24小时计时制计时并显示,蜂鸣器逢整点报时。 校时: 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报
- 2022-05-23 08:48:32下载
- 积分:1
-
freq
vhdl八位十进制数字频率计的设计,顶层和数码管扫描模块(vhdl eight decimal digital frequency meter design, top-level and digital tube scanning module)
- 2012-10-09 15:09:22下载
- 积分:1
-
NIOS II IDE 编程, LCD测试程序,仅供参考。
NIOS II IDE 编程, LCD测试程序,仅供参考。-NIOS II programming IDE, LCD testing procedures, for information purposes only.
- 2023-03-21 17:25:03下载
- 积分:1
-
mimasuo
密码锁 vhdl实现的密码锁 控制程序-mimasuo
- 2022-02-11 23:21:28下载
- 积分:1
-
数码管显示有片选 模块
四输入,与其他模块相连即可使用
数码管显示有片选 模块
四输入,与其他模块相连即可使用-digital film of the election showed that four input modules, and other modules can be linked to the use of
- 2022-08-24 22:54:51下载
- 积分:1
-
这个是用verilog语言编写的基于FPGA的交通灯控制器,分别控制四个方向上的交通灯的通断...
这个是用verilog语言编写的基于FPGA的交通灯控制器,分别控制四个方向上的交通灯的通断-The verilog language is FPGA-based traffic light controller, respectively, the four direction control of traffic lights-off
- 2022-03-22 05:17:26下载
- 积分:1
-
Verilog entry basis, as well as introduce a simple programming, verilog in recen...
verilog入门基础以及简单编程介绍,verilog是近几年发展迅速的一门硬件语言-Verilog entry basis, as well as introduce a simple programming, verilog in recent years the rapid development of a hardware language
- 2023-01-25 17:05:04下载
- 积分:1
-
priorityencodtest
parity encoder test bench
- 2015-02-08 00:32:00下载
- 积分:1
-
for Dictyophora board, in the way of achieving LCD clock function.
适合DE2板,能够在板子上的液晶显示器上实现时钟功能。-for Dictyophora board, in the way of achieving LCD clock function.
- 2023-08-10 07:45:03下载
- 积分:1