登录
首页 » VHDL » 用Verilog语言编写的实现NAND Flash块的控制存取以及同步的FIFO的控制

用Verilog语言编写的实现NAND Flash块的控制存取以及同步的FIFO的控制

于 2022-03-12 发布 文件大小:6.33 kB
0 138
下载积分: 2 下载次数: 1

代码说明:

用Verilog语言编写的实现NAND Flash块的控制存取以及同步的FIFO的控制-Using Verilog languages realize NAND Flash block to control access as well as the synchronization FIFO control

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • spartan6_GTP
    基于xilinx公司的SPARTAN6系列芯片的高速全双工串行收发器(high-speed transceiver based on spartan 6 of Xilinx PFGA)
    2018-03-08 23:14:30下载
    积分:1
  • PIDcontrolbook2
    PID CONTROLLER HELPING BOOK
    2009-03-26 18:18:04下载
    积分:1
  • FIR滤波器的基本Verilog代码实现
    FIR filter basic verilog code for implementation-FIR filter basic verilog code for implementation
    2023-05-26 13:40:03下载
    积分:1
  • shuzizhong3
    数字钟VHDL软件设计,包含多种功能,报时,12,24切换,调时(The design of VHDL digital clock software, including a variety of functions, timer, 12,24 switch, adjustable)
    2016-05-27 11:41:22下载
    积分:1
  • fir在dspbuilder下产生VHDL源码及其测试激励文件时的matlab模型,在modelsim下仿真通过...
    fir在dspbuilder下产生VHDL源码及其测试激励文件时的matlab模型,在modelsim下仿真通过-fir in dspbuilder VHDL source code under test and document the incentive mat lab model, the simulation under through modelsim
    2023-07-19 00:45:03下载
    积分:1
  • on a serial data input timing will be based on output data using two procedures
    关于一个串行数据输入 根据时序将数据分两路输出的程序 -on a serial data input timing will be based on output data using two procedures
    2022-07-26 17:19:57下载
    积分:1
  • FPGA实现数字跑表
    自己完成的项目,成功用vhdl语言实现数字跑表,可存储。
    2022-05-17 20:34:58下载
    积分:1
  • xmatchpro无损压缩
    应用背景这个无损数据压缩系统的xmatchpro算法 衍生物;从来源 ; ;以前的研究 ; ;的 ; ;作者 ;和 ;在进步 ; ;FPGA技术。使用这种技术提供的灵活性是非常大的兴趣,因为芯片可以容易适应特定应用的要求。这个在一定的弊端; ; ; ;以前的 ;方法是 ; ;克服了 ; ;使用 ; ;  xmatchpro  ;算法;设计。的目标,然后以获得更好的压缩比,并仍然保持高吞吐量和高吞吐量,因此,这和,压缩/解压缩和,过程和,不,不,慢和,原系统的。关键技术UNIX的 ; ;实用 ;“压缩” ;采用lempel-ziv-2  ; ; ;(LZ2)算法和 ; ; ;数据Lempel-Ziv压缩 ; ; ;(dclz)的家庭 ; ;压缩机 ;最初发明 ; ;的 ;休利特—目前帕卡德和 ; ;& nbsp;通过开发 ; ;啊哈[ 17 ],[ 18 ]  ;使用也 ; ;LZ2  ;衍生物。邦顿 ;和 ;博列洛 ;另一本 ; ;LZ2  ;在实施 ; ;[ 19 ]  ;, ;提高 ;在 ;数据压缩Lempel-Ziv算法。
    2022-04-09 16:54:49下载
    积分:1
  • uart
    Verilog UART is written in this file
    2013-04-16 12:34:05下载
    积分:1
  • walsh
    沃尔什函数发生器工程文件,Quartus Ⅱ 13.0版本(Walsh Function Generator)
    2020-07-03 08:20:01下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载