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quartus-mult
mult,在quartusII中，以模块输入形式，仿真乘法器mult，得到时序图和功能图(a simulation example of mult)
- 2012-10-17 14:22:11下载
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实现FPGA硬件开发使用的加法器
说明： 用于实现FPGA硬件开发使用的加法器，需要注意的是用Verilog语言实现的(The adder used to realize FPGA hardware development needs to be realized in Verilog language)
- 2020-06-22 03:20:01下载
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Uart_Analysis
rs422通信，此模块实现通信功能，使用Verilog语言(RS422 communication program, Verilog language, this module implements 422 communication function.)
- 2021-03-23 16:29:15下载
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FPGA控制PWM的程序
FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序FPGA控制PWM的程序
- 2022-10-13 04:20:04下载
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QAMMod
QAM调制，解调matlab代码，包含BPSK，QPSK,16QAM,64QAM,256QAM,1024QAM,4096QAM。其中调制方式。代码通过验证。(QAM modulator,demodulator)
- 2020-10-26 16:59:59下载
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S04_基于ZYNQ的HLS 图像算法设计基础
说明： VIVADO HLS IMAGE 使用文档(vivado image processing example text of zynq)
- 2020-06-17 11:40:02下载
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agc
无线通信中接收侧自动增益控制模块的vhdl代码实现(Receive side of the AGC module vhdl code for wireless communications)
- 2020-10-22 14:27:23下载
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802.11a的基带检测
802.11a的基带分组检测的verilog实现，其使用了分组检测的优化算法——延时相关保存算法，具有由于的检测性能。
- 2022-03-26 03:59:22下载
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基于fpga的SPI接口实现
本工程是基于Altera Cyclone系列的FPGA来实现的SPI接口，使用Verilog代码编写，能够进行 8位、 16位 、 32位数据传输的可选操作。
- 2023-04-02 17:15:05下载
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digital_clock
数字钟通过verilog实现，并且支持Modelsim仿真，通过实验验证(The digital clock is implemented by Verilog and supports Modelsim simulation)
- 2020-06-18 05:00:02下载
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