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verilog等精度测量源码(附带SPI单工通信模块)

于 2022-01-26 发布 文件大小:2.26 kB
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代码说明:

应用背景 使用verilog依靠等精度测量原理设计数字频率计,测量数据输出为64位,使用单片机进行简单的解码和显示,就能得到被测信号的频率,门控信号持续时间,也就是采样时间越长,fpga使用的晶振越准,越高速,测出来的效果越好,测量时间一定要高于被测信号的周期,这个只是取决于单片机对门控信号的控制。 等精度测量的最上层文件是dengjingduceliang.v 等精度测量的模块是DJDCL.v spi通信模块是SPI_8BYTE 使用的方法是,三个文件放在一起,上层文件和fpga的io配置好,什么输入什么输出,然后把DJDCL.v的input和标准时钟,我的是50M,还有被测信号接在一起,会输出一个64位的数据,前32位为标准时钟计时,后32位为被测信号计时,传给mcu简单计算一下就有了被测信号的频率关键技术  1.1    测频方法 这种方法即已知时基信号(频率或周期确定)做门控信号,T为已知量,然后在门控信号有效的时间段内进行输入脉冲的计数,原理图如下图所示:   请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报

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  • JV50128
    bios spi flash acer 5740g
    2013-06-28 18:48:06下载
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  • crc_verilog_xilinx
    crc校验,非常好用,是从Xilinx的IP演化来的(crc脨 拢 脩茅 拢 卢 脟 鲁 拢 潞 脙脫脙 拢 卢 脢脟)
    2021-03-01 11:49:34下载
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  • FPGAVHDL
    vhdl例程代码大全,包含流水灯,数码管,AD,DA转换等(Guinness vhdl code routines, including water lights, digital, AD, DA conversion)
    2020-12-17 12:19:13下载
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  • VerilogHDL
    基于verilog convolutional coding 的卷积编码(verilog convolutional coding )
    2012-05-09 22:56:42下载
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    2012-07-01 10:02:33下载
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  • 21452547
    加减可控制的十到十六进制计数器。完全准确,可以放心使用的(Add and subtract controllable ten to hexadecimal counter. Entirely accurate, can be at ease of use)
    2016-01-11 12:46:04下载
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