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Xilinx-Timing
Xilinx FPGA 时序约束资料,原厂出品,经典不需要理由(Xilinx FPGA timing constraint information, original, classic no reason)
- 2013-05-17 09:31:26下载
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Experimental _EDA experimental guidance notes EDA books EDA technology and VHDL...
_EDA实验讲义EDA实验指导书EDA技术与VHDL第3章EDA技术实用教程EAD技术与实践.等等资料-Experimental _EDA experimental guidance notes EDA books EDA technology and VHDL in Chapter 3 of EDA technologies utility EAD Technology and Practice Guide. And so on Information
- 2022-09-22 04:20:06下载
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GAL
有关gal器件的编程入门,以及常见逻辑门、计数器VHDL程序(For gal device programming entry, as well as common logic gates, counters VHDL program)
- 2013-07-09 22:50:01下载
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本人编写的定点除法器,开发软件为XILINX的ISE6.2,通过PAR仿真.
本人编写的定点除法器,开发软件为XILINX的ISE6.2,通过PAR仿真.-I prepared for the sentinel division, the development of software for the ISE6.2 Xilinx, PAR through simulation.
- 2022-09-14 19:00:03下载
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Asynchronous FIFO controller Verilog Design and Implementation
异步FIFO控制器的Verilog设计与实现-Asynchronous FIFO controller Verilog Design and Implementation
- 2022-08-14 15:39:50下载
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8路视频光端机的VHDL源码,此硬件使用以太网的SERDES 借用TBI接口传输PCM视频信号。...
8路视频光端机的VHDL源码,此硬件使用以太网的SERDES 借用TBI接口传输PCM视频信号。-8-channel video PDH in VHDL source code
- 2022-07-04 15:14:38下载
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《HELLO FPGA》-软件工具篇
说明: 学习使用quartus modelsim(learn to uee quartus modelsim)
- 2020-03-18 09:24:22下载
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附件 介绍了如何 使用compxlib命令编译Xilinx的ModelSim仿真库,创建这个仿真库对ISE调用modelsim是必不可少的一步,该法完全自动化,...
附件 介绍了如何 使用compxlib命令编译Xilinx的ModelSim仿真库,创建这个仿真库对ISE调用modelsim是必不可少的一步,该法完全自动化,免去繁杂的手动操作,是创建这个仿真库最简洁的方法之一-Annex compxlib introduce how to use Xilinx
- 2022-03-15 17:10:01下载
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AD9914原理图和gerber以及BOM表
DDS VHDL include everything of dds
AD9914
- 2019-06-03 09:40:52下载
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my_booth_mp
booth algotihm verilog design and test
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