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ldpc 编译码C仿真

于 2023-08-29 发布 文件大小:769.04 kB
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代码说明:

在AWGN信道下,采用BPSK调制,从txt中读入H矩阵,和生成矩阵,译码为LLR-BP译码。 该H矩阵为QC-LDPC码。仿真适用于任意码率,包括

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  • FPGA数字时钟 6.10.24进制计数器。
     错不了。。相信我。。是一个关于数字时钟需要用到的进制算法,我把他单独分开出来的模块。源码内容较为简单但是 缺 五脏俱全。原理是这样的,把时钟分为 秒模块,分模块,时模块。秒和分模块一样一起讲,以秒为例子。z秒是0-59那么有个位和十位,个位上数字是0-9,十位上是0-5.那么在秒十位上就是用十进制,在十位上用6进制。这样就可以实现秒个位到9的时候下一秒 向秒十位进1.当秒到59时候,下一秒向分的个位进1.一样的步骤实现分的进制算法。时的算法较为复杂,它分了两段来计时,在时的个位上记两次十进制,在加四的时候停止,重新从00 开始计时。时的算法解释的比较仓促,需要详情请联系我。
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  • sirt
    % Syntax: x=sirt(A,b,tolx,maxiter) % % Inputs: %       A   = Constraint matrix.     A=一个约束矩阵 %       b   = right hand side.       b=右边  %    tolx   = Terminate when the relative diff between   tolx=终止时,两次迭代之间的相对差异小于tolx。 %             two iterations is less than tolx. % maxiter   = Stop after maxiter iterations.         maxiter=停止迭代后 % % Outputs: 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报
    2022-04-06 13:18:49下载
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