-
王金明的一些学习VHDL的子
王金明的一些学习VHDL的子-Wang Jinming study of some subset of VHDL
- 2022-03-05 20:37:24下载
- 积分:1
-
16 点药材 4 FFT
16 点药材 4 FFT 与真正的价值。这被设计基于 Arduino 板和任何泰文 8 位微控制器创建的 c + + 代码。
- 2022-07-10 21:06:50下载
- 积分:1
-
实现FPGA硬件开发使用的加法器
说明: 用于实现FPGA硬件开发使用的加法器,需要注意的是用Verilog语言实现的(The adder used to realize FPGA hardware development needs to be realized in Verilog language)
- 2020-06-22 03:20:01下载
- 积分:1
-
qiartus2use
verilog仿真硬件的工具qiartus2的使用教程,内容简单易懂,初学必备(Verilog simulation tool for hardware qiartus2 the use of tutorials, easy-to-read content, learning essential)
- 2008-06-19 08:03:04下载
- 积分:1
-
FIFO
This is a simple example of FIFO(first in and first out) module written in verilog code(This is a simple example of FIFO (first in and first out) module written in verilog code)
- 2013-10-04 00:41:42下载
- 积分:1
-
LIP4210CORE_SDIO
SDIO Verilog Sourcw code
- 2021-04-29 12:58:43下载
- 积分:1
-
bldc_motor_control_design_example
无刷直流电机 VHDL VERILOG 控制,速度环,RS232 串口接收发送 始终分频 PWM生成 电机相序 actel FPGA使用-VERILOG BLDC control of the use of actel FPGA( actel VERILOG BLDC control of the use of actel FPGA)
- 2020-10-29 09:19:57下载
- 积分:1
-
Am29LV160D
Am29LV160D数据基本知识手册,基本原理及工作方式。(Am29LV160D Data basic knowledge Manual, the basic principle and ways of working.)
- 2013-06-05 19:26:08下载
- 积分:1
-
基于VHDL数字频率计
基于vhdl可用的数字频率计,误差较小,精准度较高。文件中还包含了与arm的通信模块、
- 2022-03-05 17:19:11下载
- 积分:1
-
Study_Test
实现简单的硬件加法器、除法器,实现源码文中注释(Realize simple hardware adder and divider, realize source code)
- 2020-06-21 05:20:01下载
- 积分:1