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fir在dspbuilder下产生VHDL源码及其测试激励文件时的matlab模型,在modelsim下仿真通过...

于 2023-07-19 发布 文件大小:6.36 kB
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fir在dspbuilder下产生VHDL源码及其测试激励文件时的matlab模型,在modelsim下仿真通过-fir in dspbuilder VHDL source code under test and document the incentive mat lab model, the simulation under through modelsim

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  • mu0
    基于Xilinx Spartan6的 一个简单的CPU MU0 VHDL(Based on a simple CPU Xilinx Spartan6 of MU0 VHDL)
    2020-12-07 08:29:22下载
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  • 23565785scan_led
    Quartus环境下的7段扫描显示电路的源程序(Quartus environment of the seven scanning display circuit of the source)
    2006-12-11 17:11:41下载
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  • vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波(A、B)的频率、幅度可控输出(方波 A的占空比也是可控的),可以存储任意波形特征数据并能重现该...
    vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波(A、B)的频率、幅度可控输出(方波 A的占空比也是可控的),可以存储任意波形特征数据并能重现该波形,还可完成 各种波形的线形叠加输出。 -vhdl waveform occurred procedures. 4 achieve common sinusoidal waveform, 1.30, sawtooth, square-wave (A, B) the frequency and amplitude control output (square A duty cycle is also controllable), can store data of arbitrary waveform characteristics and able to reproduce the waveform, but also through a variety of linear superposition of the waveform output.
    2023-03-26 13:10:03下载
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  • DDS
    可以产生正弦波,三角波、锯齿波、方波,要求频率1Hz-100kHz,步进1Hz,具有自动扫频功能; 正弦波的相位可调,方波的占空比可调; (Can generate sine wave, triangle wave, sawtooth wave and square wave, the required frequency of 1 hz- 100 KHZ, step 1 hz, with functions of automatic frequency sweep The phase adjustable sine wave, square wave duty ratio is adjustable )
    2021-05-07 02:58:36下载
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  • ldpc
    低密度校验码 ,很好用的代码,功能已经实现编码和译码(fpga ldpc)
    2014-04-09 10:24:51下载
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  • from across the Xilinx website, learning some FPGA dynamic reconfigurable good e...
    从Xilinx网站上下的,学习FPGA部分动态重配置很好的例子。-from across the Xilinx website, learning some FPGA dynamic reconfigurable good example.
    2023-03-28 16:10:04下载
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  • vhdl 键盘程序,对键盘输入的字符进行判断,写入fpga中
    vhdl 键盘程序,对键盘输入的字符进行判断,写入fpga中-VHDL key
    2022-03-03 15:13:57下载
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  • mif
    使用metlab生产正弦波和三角波的采样值,供vhdl等语言调用来产生波形(use metlab production sine wave and triangular wave of sampling, for languages such as call vhdl to generate waveforms)
    2007-05-15 15:51:39下载
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  • 高速FIFO,verilog设计。速度高达130Mhz
    高速FIFO,verilog设计。速度高达130Mhz-High-speed FIFO, verilog design. Speed up to 130MHz
    2023-06-26 05:15:03下载
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  • 通过UART从PC主机读取图片数据,并完成图片在VGA显示器上的显示...
    通过UART从PC主机读取图片数据,并完成图片在VGA显示器上的显示-through UART from the host PC to read image data, and complete picture of the VGA display on the show
    2023-08-09 21:00:04下载
    积分:1
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