序列检测器的实现采用Verilog HDL模拟使用ModelSim

ＵＣ1698Ｕ驱动160*160ＬＣＤ中文应用及例程(UC1698U driver 160* 160LCD Chinese applications and routines)

此程序用于LED跑马灯，是面向于Core3s250e的XILINX的程序，采用ISE 14.6编写，可以直接下载到3s250e中，经过下载可用。对于verilog初学者非常有益，希望可以共同学习。

说明：  单周期cpu，使用verilog编写的的单周期cpu支持......等功能(Single cycle CPU, using Verilog written single cycle CPU support... And other functions)

在quartus平台下使用verilog语言编程实现简单的单流水线CPU，可以执行16条基本指令(Quartus platform in the verilog language programming using a simple single-line CPU, can perform 16 basic instructions)

具有16个校验位的RS编码器，在FPGA上实现。(With 16 RS encoder, the parity bit in the FPGA.)

40M时钟输入经过iserdes倍频到960M(input 40M o clock and output 960M )

用FPGA实现DDS波形发生器。可以实现方波，三角波，正弦波的切换，实现频率的调节。三角波和正弦波均用查表法实现。本文档包括一个主程序的代码，按键和显示的实例化程序代码、调用ROM生成的代码以及正弦波和三角波实现的数据表。

能够在EDA环境下实现四位十进制数字密码锁的设置与开锁功能，并能更改使用密码，还可以防止抖动(EDA environment to achieve four decimal code lock and unlock function of the settings and change the use of passwords, but also to prevent the jitter)

r80515源代码，包含说明文档。FPGA验证通过(r80515 source code, including documentation. Verified by FPGA)

说明：  FPGA锁相环实验： 顶层文件加底层IP文件构成 top中例化ip核pll(Experiment of Phase-Locked Loop Based on FPGA)