-
带自适应波特率发生器UART实现,经过FPGA验证的!
带自适应波特率发生器UART实现,经过FPGA验证的!-UART baud rate generator with adaptive realization, after FPGA validation!
- 2023-01-21 06:20:04下载
- 积分:1
-
1
matlab code for JTAG cable checking
- 2014-02-04 19:27:39下载
- 积分:1
-
VHDL,Flappy bird
Flappy bird是一个相当有名的游戏,由越南的开发者 — —MrDong H.Nguyen iOSand Android 平台上。用简单的但是非常太有趣了,它只是吸引了数以百万计世界各地的人们下载和玩了。它具有最佳免费应用程序的应用商店和播放存储由的节拍 1 号2014 年 1 月。在这个游戏中,玩家必须尝试到一只鸟飞,避免管道的控件。核战鸟直通管 player‟s 得分将由一个折痕。试着控制只鸟飞过来,只要你可以,你可以得到分别奖牌与你的分数。这个游戏的 facinasting 的启发,决定尝试到的 we‟re 创造了这个游戏用 vhdl 实现的 DE1 板。We‟ll 有一些不同的想法比较原始医管局东的版本。We‟re 希望我们的努力将使游戏更多的乐趣和更多的挑战也
- 2022-01-25 16:05:27下载
- 积分:1
-
ISE
设计一4位比较器,画出门级电路图,用verilog语言完成设计。
(Design a four comparators, drawing out level circuit diagram, complete the design using verilog language. )
- 2015-12-11 21:16:12下载
- 积分:1
-
vbyuanma
示波器的源码,基于串行口的,(oscilloscope source code, based on the serial port,)
- 2007-04-18 19:11:22下载
- 积分:1
-
FPGAPVC_3
基于SDRAM的PCI采集,上位机为VC编写,桥芯片为PLX9054,项目已经做完,上传5个例程,已经验证通过(SDRAM, PCI-based acquisition, PC for VC preparation, bridge chip for PLX9054, the project has been done, upload 5 routines, has been verified by)
- 2015-01-07 22:53:10下载
- 积分:1
-
vga接口的工程实现,基于altera环境,需要的可以
vga接口的工程实现,基于altera环境,需要的可以-vga interface engineering implementation, based on altera environment, need to take a look at
- 2023-04-22 21:05:04下载
- 积分:1
-
V2.tar
SDIO slave, written in verilog, does not support SPI mode.
- 2021-04-05 16:59:04下载
- 积分:1
-
RS_255_223_ENCODER
rs255编码解码器,verilog描述,FPGA实现(RS255 223 ENCODER)
- 2015-03-30 09:52:09下载
- 积分:1
-
本程序是用VHDL语言实现电子密码锁功能,整个系统分为三大模块,一为控制模块,二为键盘显示模块,三为处理模块...
本程序是用VHDL语言实现电子密码锁功能,整个系统分为三大模块,一为控制模块,二为键盘显示模块,三为处理模块-This procedure is a VHDL language electronic code lock function, the entire system is divided into three modules, one for the control module, two for the keyboard display module, three modules for the treatment
- 2022-05-08 19:29:46下载
- 积分:1