登录
首页 » VHDL » 串口模块程序,可以实现串行发送和接收功能,比特率可以不断调整,数据的长度是可以改变的...

串口模块程序,可以实现串行发送和接收功能,比特率可以不断调整,数据的长度是可以改变的...

于 2022-11-12 发布 文件大小:634.00 B
0 204
下载积分: 2 下载次数: 1

代码说明:

串口模块程序,可以实现串行发送和接收功能,比特率可以不断调整,数据的长度是可以改变的-Serial port module program, you can achieve the serial send and receive functions, and bit rate can be continuously adjusted, the data length can be changed

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 用VHDL写的4*4乘法器,学习VHDL语言的可以
    用VHDL写的4*4乘法器,学习VHDL语言的可以-Use VHDL to write the 4* 4 multiplier, learning VHDL language can be
    2022-02-11 23:38:12下载
    积分:1
  • CPU
    不同方法实现的CPU系统。同样支持加减乘,逻辑/算术移位,与或非等建议指令。(Different methods to achieve CPU system. Also supports, subtraction, multiplication, logic/arithmetic shift, and the like or recommend instruction.)
    2016-04-16 20:30:51下载
    积分:1
  • this come from alter ,you can look and find it on line about USB
    this come from alter ,you can look and find it on line about USB
    2023-09-06 16:15:03下载
    积分:1
  • VESA Timing
    VESA CVT视频参数计算器,输入分辨率和刷新率即可得到需要参数。(VGA Timing Calculator)
    2020-12-23 14:29:07下载
    积分:1
  • FPGA verilog代码
    说明:  数电实验FPGA verilog代码,包括秒表、全加器、半加器等。(FPGA Verilog code for digital experiment)
    2020-04-29 11:16:05下载
    积分:1
  • lab4
    说明:  lab report for lab 4
    2019-04-17 21:17:08下载
    积分:1
  • Dc to use a very good book a very good use of books dc
    一个非常好的dc使用书籍 一个非常好的dc使用书籍-Dc to use a very good book a very good use of books dc
    2022-03-02 00:03:36下载
    积分:1
  • viterbi_soft
    维特比译码器,调用IP核,软判决输入,开发平台Xilinx Spartan-6系列FPGA(viterbi decoder, using IP core resource, soft decision input,develop platform is Xilinx Spartan-6 series FPGA)
    2021-01-17 22:58:46下载
    积分:1
  • add
    浮点加法器的用Verilog实现,32位的浮点加法器(Floating point adder Verilog)
    2021-02-28 12:49:35下载
    积分:1
  • quartus-mult
    mult,在quartusII中,以模块输入形式,仿真乘法器mult,得到时序图和功能图(a simulation example of mult)
    2012-10-17 14:22:11下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载