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48_4.12
网络通信中的MII接口
通常将4位nibble数据送出,此程序将4位数据组合成8位数据并行输出(8比特==1个字节)。。完全可用
同时包含84转换(The MII network interface usually sent four nibble data, this procedure will be 4-bit data into 8-bit parallel output data (8 bits == 1 byte). . Completely available at the same time contains 84 conversion)
- 2009-04-21 13:43:45下载
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ahb_sramc_vtb
ahb总线Verilog代码及Verilog仿真文件(ahb bus Verilog code and Verilog simulation code)
- 2020-08-25 20:48:15下载
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FPGA
verilog编写的QPSK发射机的FPGA部分,已经过验证,完全达到要求。调制矢量误差4%(QPSK transmitter verilog prepared by the FPGA portion, has been proven, fully meet the requirements. Modulation vector error of 4 )
- 2013-10-08 14:58:23下载
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adder
用于实现FPGA硬件开发使用的加法器,需要注意的是用Verilog语言实现的(The adder used to realize FPGA hardware development needs to be realized in Verilog language)
- 2020-06-22 03:20:01下载
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qam_64
Verilog语言下QAM调制的DDS实现(The QAM Modulation DDS achieve)
- 2021-02-20 11:59:43下载
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VHDL FPGA 流水灯实验
应用背景流水灯实验,FPGA基础 设计流程 程序下载 流水灯实验,FPGA基础 设计流程 程序下载流水灯实验,FPGA基础 设计流程 程序下载流水灯实验,FPGA基础 设计流程 程序下载流水灯实验,FPGA基础 设计流程 程序下载流水灯实验,FPGA基础 设计流程 程序下载流水灯实验,FPGA基础 设计流程 程序下载流水灯实验,FPGA基础 设计流程 程序下载关键技术VHDL 基本语法 设计思想 FPGA基础实例 VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例
- 2022-03-05 21:23:07下载
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4个7段lcd同时显示的程序,已经在digilent的nexy2板上通过验证,非常好用易懂,适合初学者学习...
4个7段lcd同时显示的程序,已经在digilent的nexy2板上通过验证,非常好用易懂,适合初学者学习-display 4 leds
- 2022-09-21 08:15:03下载
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multifreqvhdl
说明: 资料是本人根据相关文献资料用vhdl语言编写的旋转机械鉴相信号倍频的程序,multifre1.vhd是倍频程序,multifre1.vwf是仿真波形文件,stp1.stp是虚拟逻辑分析仪signaltap文件。该倍频程序可以直接使用,可以设置倍频数,修改实体参数N即可。(According to the literature data is the information I have written in with vhdl Rotating Machinery Kam believe that the procedure multiplier number, multifre1.vhd is the multiplier process, multifre1.vwf is the simulation waveform files, stp1.stp a virtual logic analyzer signaltap file. The multiplier process can be used directly, you can set the multiplier number, modify the parameter N can be solid.)
- 2010-04-26 16:05:18下载
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The VHDL source code digital clock, you can achieve at school, school grade feat...
数字钟的VHDL源程序,可以实现校时,校分等功能,并在试验箱上运行成功-The VHDL source code digital clock, you can achieve at school, school grade features, and success in the chamber is running on
- 2023-02-06 10:05:04下载
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srfft_test
基于分裂基的蝶型FFT,用C实现,经过测试,没有错误,可以直接拿去使用。(Based on the division of FFT butterfly type, use C implementation, tested, no error, can directly use.
)
- 2016-05-05 22:35:40下载
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