登录
首页 » VHDL » verilog prescaler for the realization of the odd

verilog prescaler for the realization of the odd

于 2022-08-08 发布 文件大小:578.00 B
0 149
下载积分: 2 下载次数: 1

代码说明:

verilog实现的奇数分频器 针对任何规模的奇数分频-verilog prescaler for the realization of the odd-numbered odd-numbered points of any size-frequency

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • PCIe
    本书共由三篇组成。其中第一篇由第1~3章组成,介绍PCI总线的基础知识。第二篇 由第4~13章组成,介绍PCIExpress总线的相关概念。第二篇的内容以第一篇为基础。(This book comprises a total of three components. The first chapter from the first 1-3 chapters, introduces the basics of the PCI bus. Second by the first 4 to 13 chapters, introduces concepts related PCIExpress bus. The contents of the first to second basis.)
    2020-06-26 17:20:02下载
    积分:1
  • 基于VHDL的RS232通讯程序,包含完整的源代码,锁脚文件以及下载文件,可直接下载使用...
    基于VHDL的RS232通讯程序,包含完整的源代码,锁脚文件以及下载文件,可直接下载使用-VHDL based on the RS232 communication procedures, including complete source code, locking pin, as well as download files documents can be directly downloaded using
    2023-07-14 19:45:03下载
    积分:1
  • an471
    说明:  FPGA PLL 分析,包括时序分析等等。。。。。。。。。(FPGA PLL Analysis)
    2010-04-25 20:35:08下载
    积分:1
  • vhdl
    说明:  vhdl常见小实验代码,包括二进制比较器,4选1,8421十进制,8421转化成格雷码,8421余三码,分频器,数据码译码器,二进制减计数器,四位环形计数器等(VHDL common small experiment code)
    2020-06-24 13:00:02下载
    积分:1
  • usbFPGAconnect
    该例程是PC机通过FX2-CY7C68013-A的USB2.0控制芯片与FPGA实现通信。其中的工程和代码包括PC机上的USB固件程序、驱动程序、上位机程序,FPGA上的VERILOG通信程序。(The routine is a PC, through the FX2-CY7C68013-A of the USB2.0 controller chip and the FPGA to achieve communication. One of the projects and code, including PC, the USB firmware, drivers, FPGA' s Communication Program)
    2021-04-08 15:19:00下载
    积分:1
  • 异步FIFO的设计仿真和综合技术
    Simulation and Synthesis Techniques for Asynchronous FIFO Design
    2022-07-12 03:34:39下载
    积分:1
  • SAR-ADC
    Complete Successive approximation Analog to digital converter along with the source code
    2013-04-21 23:42:03下载
    积分:1
  • xilinx公司的FPGA实现数字视频信号处理器。语言是VHDL。
    xilinx公司的FPGA实现数字视频信号处理器。语言是VHDL。-Xilinx FPGA to achieve the company
    2022-10-21 12:30:03下载
    积分:1
  • a
    说明:  用verilog实现除法器,调用了ip核,不仅有源代码,还有测试程序的时序编写(verilog ise divider)
    2013-07-21 15:03:31下载
    积分:1
  • Several common multiplier Verilog, VHDL code
    几种常用乘法器的Verilog、VHDL代码-Several common multiplier Verilog, VHDL code
    2022-03-12 09:47:07下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载