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VHDL Programing

于 2022-07-03 发布 文件大小:1.70 MB
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VHDL Programing

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  • 按键边缘检测
    用Verilog编写的基于FPGA的按键边缘检测技术,通过此模块可以很好的消除在按键过程中因抖动或误按造成的 麻烦,同时,在边缘检测技术中使用了约翰逊计数器的思想,是的代码简介,思路清晰。源码中含有大量的注释,有助于读者更好地了解编码思想。
    2022-03-22 02:23:06下载
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  • 数字频率计~ VHDL 实现 可以实现频率的测量和现实的功能 8位
    数字频率计~ VHDL 实现 可以实现频率的测量和现实的功能 8位-digtal frequency tester (use vhdl) can be used to test frequency (8bit)
    2022-04-10 23:14:01下载
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  • EDA-Cont-LED-201006
    FPGA-CPLD实习计数器7段数码管控制接口设计与LED显示控制,FPGA译码(FPGA-CPLD internship counter 7-segment LED control interface design and LED display control, FPGA decoder)
    2013-05-11 23:09:25下载
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  • Verilog&Vhdl混语言对SDRAM的控制源代码,提供了很好的例子,顶层文件为sdrm.v!...
    Verilog&Vhdl混语言对SDRAM的控制源代码,提供了很好的例子,顶层文件为sdrm.v!-VerilogVhdl mixed language SDRAM control of the source code, provided a good example of top-level documents sdrm.v!
    2022-03-18 22:36:54下载
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  • verilog based Real Time clock with manual input implement on fpga
    它是一个基于verilog的数字时钟,显示时-分-秒,它可以手动输入,并为时、分和秒分配3个开关第二,它数字时钟频率是实时设置的。我自己用逻辑开发的。。。
    2022-01-26 02:23:56下载
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  • Receiver
    该程序是整个OFDM接收机的程序,希望对做这方面的朋友用些帮助,也希望朋友们和我一起探讨OFDM收发信机。(The program is the whole OFDM receiver process, hope to do in this area with some friends to help and also hope that friends and I explore OFDM transceiver.)
    2010-01-03 13:44:38下载
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  • arccos
    一个求反余弦的cordic算法,整个工程。包括仿真。可以直接打开。(An inverse cosine of the cordic seeking algorithms, the whole project. Including the simulation. Can be directly opened.)
    2009-11-04 22:48:00下载
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  • 8 位加法器
    有一个 8 位全加器 VHDL 代码。我测试该代码在协同,看到了这段代码的工作。
    2022-04-21 11:16:03下载
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  • Vhdl实现计算exp功能 在apex20k上经过验证
    Vhdl实现计算exp功能 在apex20k上经过验证-Vhdl achieve in terms exp function on proven apex20k
    2022-07-21 03:19:31下载
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  • 14_SDRAM
    说明:  高速流水的SDRAM控制器,最高速度可达速度在200M左右(high speed SDRAM controller)
    2019-06-17 18:43:54下载
    积分:1
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