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state-machine
一个简单的用verilog实现的售货机状态机设计,内有word介绍设计的原理(A simple realization of a vending machine with verilog state machine design, there are design principles introduced word)
- 2021-01-20 23:48:42下载
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BT656_RGB
说明: 将BT656数据流转换成RGB图像格式的数据(Converting BT656 data stream into RGB image format)
- 2021-03-22 09:29:17下载
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一个简单的DDS
采用DDS方法在FPGA上实现频率发生器,最大频率设置在9999Hz,输出正弦波。
DDS是一种从相位概念出发直接合成所需要的波形的新的全数字频率合成技术。同传统的频率合成技术相比,DDS技术具有极高的频率分辨率、极快的变频速度,变频相位连续、相位噪声低,易于功能扩展和全数字化便于集成,容易实现对输出信号的多种调制等优点,满足了现代电子系统的许多要求,因此得到了迅速的发展。
- 2022-03-22 02:09:46下载
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tdm_latest[1]
TDM,就是时分复用。本程序完成4通道,没通道最多32路64K信号的交换,就是说可以完成32x4个电话信号交换(TDM, is time-division multiplexing. The process is complete 4-channel, no channel up to 64K 32 to exchange signals, that can be done 32x4 telephone signal exchange)
- 2010-07-07 15:28:06下载
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dct
里面含有vhdl和verilog 版本,很好用!dct变换用得很多啊!(Which contains a VHDL and Verilog versions of very good use! Dct transform with a lot ah!)
- 2007-08-27 16:00:31下载
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Based on VHDL+ FPGA design of the DDS signal gennerator has been through debug mode
一个用VHDL设计的DDS信号发生器,包括两个pics的仿真结果。
- 2022-09-21 09:15:03下载
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自己写得一个关于sine(32X24)的程序
自己写得一个关于sine(32X24)的程序-own written on a sine (32X24) procedures
- 2022-02-28 22:21:58下载
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sm4 vhdl
sm4密码算法在FPGA上的实现。 编程语言为VHDL,开发工具是quartus13.1,已在modelsim上仿真通过。压缩包包含两个.v文件,一个是sm4算法的库函数文件,一个是sm4算法的top文件。
- 2022-11-05 14:20:03下载
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SRAM
进阶实验之SRAM测试,由verilog编写,可直接对sram进行存写(Advanced SRAM test experiments, written by the verilog, can be stored directly on the sram write)
- 2011-08-18 01:58:56下载
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VHDL的食谱
The VHDL Cookbook
First Edition
July, 1990
Peter J. Ashenden
Dept. Computer Science
University of Adelaide
South Australia
- 2023-02-13 13:30:04下载
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