登录
首页 » VHDL » 基于FPGA的数字钟

基于FPGA的数字钟

于 2022-05-23 发布 文件大小:282.74 kB
0 212
下载积分: 2 下载次数: 1

代码说明:

1.设计一个具有24进制计时、显示、整点报时、时间设置和闹钟功能的数字钟,要求时钟的最小分辨率时间为1s。2.多功能数字钟系统功能的具体描述如下:     计时:正常工作状态下,每日按24小时计时制计时并显示,蜂鸣器逢整点报时。     校时: 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • Get-20-point
    this program get 20 point from user and draw functions.
    2014-01-09 03:25:06下载
    积分:1
  • Walsh
    沃尔什函数序列sequency的verilog编程实现,含有测试文件(the Walsh sequence in sequency order)
    2020-07-03 08:20:01下载
    积分:1
  • 一篇用VHDL实现快速傅立叶变换的论文
    一篇用VHDL实现快速傅立叶变换的论文,包括原理分析和代码实现,印度圣雄甘地大学M.A.学院提供(VHDL with a Fast Fourier Transform papers, including the principle of analysis and implementation of the code, the Mahatma Gandhi Institute of the University of Marat)
    2004-10-05 11:06:01下载
    积分:1
  • SDI HDMI 视频转换器和发射机
    本项目接收高清 sdi 广播的视频,并将其转换为 HDMI 接口的显示器上显示。 这个项目只需要 20 位的视频数据和从它和使用标志首先 YCbCr 视频数据转换为 RGB 数据,然后编码到 HDMI 提取时间标志。 本模块需要 74.25 MHz 的时钟。
    2022-07-21 06:21:42下载
    积分:1
  • altera de2 sd 卡源程序。调试成功的
    altera de2 sd 卡源程序。调试成功的-altera de2 sd card source. Debugging success
    2022-06-20 23:18:53下载
    积分:1
  • 这里有一个实例
    here is a VHDL example
    2023-08-26 14:35:05下载
    积分:1
  • 这是最后一个,处理器内部ROM,如有需要,大家就顶
    这是最后一个,处理器内部ROM,如有需要,大家就顶-this is the last one, the processors internal ROM, if necessary, on the top you
    2022-01-26 08:01:31下载
    积分:1
  • 一个任意整数分频程序,采用VHDL语言编写,编译通过
    一个任意整数分频程序,采用VHDL语言编写,编译通过-An arbitrary integer frequency procedure for the VHDL language, the compiler through
    2022-02-03 15:22:59下载
    积分:1
  • MIPS_LANG
    verilog实现misp架构,并且支持modelsim仿真(Verilog implements MISP architecture and supports Modelsim simulation)
    2020-06-18 04:40:02下载
    积分:1
  • docs
    papers based on distributed arithmetic.
    2014-02-06 16:17:09下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载