-
chenxu
电子时钟,可以显示四位,两位显示分钟,两位显示秒,可以用按键控制清零,以及加减数(Electronic clock, you can display four bit, two bit display minutes, the second display seconds, can be used to control the key to clear, and the addition of subtraction)
- 2017-04-22 21:29:14下载
- 积分:1
-
BCH3
BCH3.c,提供m<21以下的所有码长的BCH编解码模块。以供大家参考。谢谢(BCH encoder&decoder GF(2^m) m<21)
- 2021-01-26 11:58:36下载
- 积分:1
-
sep_fram_v0.0
直接序列扩频系统的收发系统,可以进行参数配置(this is a Verilog program )
- 2016-03-01 13:22:03下载
- 积分:1
-
verilog中调用门级电路的实验程序,实现了门级舰模
verilog中调用门级电路的实验程序,实现了门级舰模-call Verilog gate-level circuit of the experimental procedures, to achieve a gate-level ship-mode
- 2022-10-03 09:10:04下载
- 积分:1
-
ise9.1
学习ISE的好资料,想要使用XILINX芯片进行开发必看(ISE learning good information, want to use a must-see XILINX chip development)
- 2009-05-15 09:04:15下载
- 积分:1
-
VHDL语言程序集。PDF格式,所有的例子,你将看不到偷…
vhdl语言例程集锦.pdf,全部的例子,看你会不会偷了-VHDL language routines Collection. pdf, all the examples, you will not see stealing
- 2022-02-11 21:16:40下载
- 积分:1
-
4x4键盘模块。这个文件包括普通的键盘设计方案说明和相关的原程序。...
4x4键盘模块。这个文件包括普通的键盘设计方案说明和相关的原程序。-4x4 keyboard module. The documents include ordinary keyboard design program descriptions and procedures related to the original.
- 2022-01-26 02:27:17下载
- 积分:1
-
sy3
说明: 多路信号复用基带系统的建模与设计,按位同步复接并掌握四路同步复接器的VHDL设计及系统的时序仿真。(library ieee
use ieee.std_logic_1164.all
use ieee.std_logic_unsigned.all
)
- 2010-04-08 13:01:56下载
- 积分:1
-
fpga0023202323
FPGA时序分析说明。对于高速时钟设计中的时序分析与约束有帮助(FPGA,TIME)
- 2010-11-01 15:49:34下载
- 积分:1
-
XC3S700_UART_Test
红色飓风3S700AN开发板UART测试例程(Red Hurricane 3S700AN development board UART test code)
- 2013-07-12 00:34:31下载
- 积分:1