登录
首页 » Verilog » AHB 转移到 APB 源和建业读/写 verilog 代码

AHB 转移到 APB 源和建业读/写 verilog 代码

于 2022-04-10 发布 文件大小:6.31 kB
0 179
下载积分: 2 下载次数: 1

代码说明:

转换AHB外围转移到APB转移16槽孔APB桥提供高速AHB之间的界面域和低功率的APB域。大桥出现在AHB奴隶,而在APB,它是主人。读取和写入的AHB接送转换成相应的APB传输。由于APB不流水线,等待状态转移过程中加入,并从建业的时候在AHB需要等待APB协议。在AHB到APB桥包括一个状态机,它被用来控制产生的APB和AHB输出信号,以及地址解码逻辑,用于生成所述APB外设选择线。在系统中使用的所有寄存器被从的上升沿时钟系统时钟HCLK,并使用异步复位HRESETn

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • alu
    the 8 bit alu by verilog
    2011-05-26 11:25:43下载
    积分:1
  • 100_Power_Tips_for_FPGA_Designersi
    fpga高手设计实战真经100则,最新的FPGA英文书籍,值得参考学习(100 Power Tips for FPGA Designers,The new FPGA English books, worth learning)
    2013-12-06 19:40:43下载
    积分:1
  • 简单的CPU(源代码和合成脚本)
    应用背景此文件包含所有的源代码和脚本,以Altera公司的简单CPU的合成。500MHz时钟设计运行。 ;关键技术使用CLA提高速度的设计。这只是一个简单的CPU,它的结构很简单,它没有任何管道或类似的东西。
    2022-04-30 14:14:37下载
    积分:1
  • Verilog数字系统设计教程(第二版) 夏宇闻
    说明:  Verilog数字系统设计教程(第二版) 夏宇闻(Verilog Digital System Design Course (2nd Edition) Xia Yuwen)
    2020-06-20 18:40:02下载
    积分:1
  • 11-07-11
    AD9910实现脉冲内线性调频信号,仅供参考(AD9910 to achieve linear FM pulse signal, for reference only)
    2013-09-16 10:52:00下载
    积分:1
  • Verilog-SRAM
    用verilog hdl语言编写的fpga与片外sram 的读写控制(With the verilog hdl language fpga sram chip with read and write control)
    2020-12-09 15:39:18下载
    积分:1
  • DW_apb_timer
    verilog实现计时器timer,可直接用于芯片开发中。(verilog achieve timer, it can be directly used for chip development.)
    2016-04-05 22:37:39下载
    积分:1
  • cn1
    在MATLAB的SIMULINK中,用DSPBUILDER实现计数功能,控制LED指示灯.(In MATLAB SIMULINK, DSPBUILDER is used to realize counting function and control LED indicator lamp.)
    2018-08-16 15:35:47下载
    积分:1
  • RobustVerilog_free1.2_win
    RobustVerilog生成verilog工具(RobustVerilog version)
    2021-01-22 18:18:41下载
    积分:1
  • generic_dpram
    IT IS THE DP MEMORY MODULE. IT CONTROLS THE DP MEMORY
    2013-09-30 19:03:40下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载