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HTTP 测试工具 restclient-ui-3.2.2，可以模拟HTTP请求进行测试，可以设置content type 等

完整的《Xilinx ISE 9.x FPGA/CPLD设计指南》开发资料，若不能下载请留言

本人写的基于FPGA的LCD1602显示模块。经过本人测试，已经用在项目中。

VB编写的PID模拟程序，可以用于学习PID算法

本设计是采用EDA技术设计的一种8B /10B 编解码电路,实现了在高速的串行数据传输中的直流平衡。利用verilog HDL 逻辑设计语言，经过modelsim、quartus II的仿真和下载验证，实现其编码和解码的功能。该编解码电路设计大体上可以由五个模块构成，分别是默认编码模块、差异度计算模块、编码校正模块、并串转换模块、显示模块。采用Verilog HDL 描述、modelsim 10.2a 进行功能仿真、Quartus II 13.1 进行FPGA逻辑综合和适配下载，最后在Alter 公司的Cyclone IV E 的芯片EP4CE6F17C8 上实现并完成测试。资源包中附有

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用身高体重数据进行性别分类的实验用本组采集的数据作训练样本，采用身高和体重为特征进行性别分类，在正态分布假设下估计概率密度，建立最小错误率贝叶斯分类器，写出得到的决策规则；将分类器应用到训练集上计算训练错误率；把分类器应用到dataset1.txt 上，计算测试错误率。在分类器设计时尝试采用不同先验概率（比如0.5 对0.5，0.24 对0.76 等），考查对决策和错误率的影响。自行给出一个决策表，采用最小风险贝叶斯决策重复上面的实验。用题2 中得到的似然比或对数似然比为分类指标，粗略画出ROC 曲线。