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verilog 比较基础的教程 呵呵 新手学习学习啊 大家有资料工乡

于 2023-08-29 发布 文件大小:283.81 kB
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verilog 比较基础的教程 呵呵 新手学习学习啊 大家有资料工乡-basis of comparison of the tutorial Verilog Ha ha ah novice learn Rural U.S. Data Works

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  • sm4
    VHDL实现国家SM4加密算法(ECB)模式 (VHDL to achieve national SM4 encryption algorithm (ECB) mode)
    2020-08-12 06:58:26下载
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  • dda
    该程序描述了运用FPGA 实现DDA圆弧插补运算(FPGA DDA)
    2020-11-29 13:09:28下载
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    I2C配置tvp5150用VHDL写的 -I2C configuration tvp5150 written using VHDL
    2023-05-02 14:30:04下载
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    万能频率器,可以修改其中的参数,可是实现任意的分频!很方便!-Universal frequency, you can modify one of the parameters, but any implementation of the sub-band! Very convenient!
    2022-01-26 04:43:16下载
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    用VHDL语言设计四位全加器,有低位进位和高位进位。-VHDL language with four full-adder design, there are low and the high binary binary.
    2022-03-20 15:03:38下载
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  • code
    涉及到常用的模块,参数可配置,可以很方便的集成到应用中(Related to commonly used modules, parameters can be configured, can be easily integrated into applications)
    2008-06-13 22:30:14下载
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  • LDPC
    LDPC Encoding Ebook Tetourial code
    2021-03-23 08:49:15下载
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  • 本代码介绍了使用VHDL开发FPGA的一般流程,最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL,在软件开发平台ISE上完成,可以...
    本代码介绍了使用VHDL开发FPGA的一般流程,最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL,在软件开发平台ISE上完成,可以在较高速时钟频率(100MHz)下正常工作。该设计的频率计能准确的测量频率在1Hz到100MHz之间的信号。使用ModelSim仿真软件对VHDL程序做了仿真,并完成了综合布局布线,最终下载到芯片Spartan-II上取得良好测试效果。-the code on the FPGA using VHDL development of the general process, finally adopted a FPGA-based digital frequency method. The design using VHDL hardware description language, the software development platform ISE completed, the higher speed clock frequency (100MHz) under normal work. The design of the frequency meter can be accurately measured in a frequency of 100MHz between Hz signal. Use ModelSim VHDL simulation software to do the simulation process, and completed a comprehensive layout cabling, downloaded to the final chip Spartan-II made good on the test results.
    2022-10-09 05:15:03下载
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  • filter
    说明:  A low pass filter module based on FPGA, easy to transplant
    2020-05-04 10:21:42下载
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  • 24_Timer
    说明:  使用Verilog编写的24位定时器,具有apb 总线接口,可以设置工作方式和计数初值。(The 24-bit timer written by Verilog has APB bus interface, which can set working mode and count initial value.)
    2021-04-27 21:38:44下载
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