登录
首页 » VHDL » verilog例子资源,对于初学者很有帮助。

verilog例子资源,对于初学者很有帮助。

于 2023-08-15 发布 文件大小:90.56 kB
0 136
下载积分: 2 下载次数: 1

代码说明:

verilog例子资源,对于初学者很有帮助。-verilog examples of resources are very useful for beginners.

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • Radix-8 Booth Encoded Modulo
    vhdl 代码为基数 8 展位编码模块乘数与自适应延迟的高动态范围残留一些系统
    2022-08-25 03:41:29下载
    积分:1
  • 数码管显示有片选 模块 四输入,与其他模块相连即可使用
    数码管显示有片选 模块 四输入,与其他模块相连即可使用-digital film of the election showed that four input modules, and other modules can be linked to the use of
    2022-08-24 22:54:51下载
    积分:1
  • CSC_mat
    彩色空间转换,RGB和YUV互转的matlab源码(RGB converting to YUV, YUV converting to RGB, Matlab source code)
    2014-12-24 10:15:57下载
    积分:1
  • verilog-montgomery-RSA
    基于Montgoery 算法的RSA,FPGA verilog 实现,有测试文件(Based on Montgoery algorithm for RSA,FPGA verilog implementation,bench file)
    2021-04-27 20:28:44下载
    积分:1
  • 拔河电路的设计
    VHDL拔河电路的设计 基于cyclone V  VHDL拔河电路的设计 基于cyclone V VHDL巴赫电路的设计 基于cyclone V VHDL巴赫电路的设计 基于cyclone V VHDL巴赫电路的设计 基于cyclone V
    2022-07-16 17:58:29下载
    积分:1
  • DDR_interface
    高速DDR存储器数据接口设计实例. 1. 将文件拷入硬盘 2. 产生DQS模块 3. 产生DQ模块 4. 产生PLL模块 5. 拷贝以上步骤生成的文件到子目录【Project】中 6. 打开子目录【Project】中的DataPath.qpf工程,设计顶层模块 7. 编译并查看编译结果 (High-speed DDR memory interface design data. 1. Copyed into the document hard disk 2. DQS generated module 3. Have a DQ module 4. Have a PLL module 5. Copies of the above steps to generate a document to a subdirectory 【Project】 6. Open the subdirectory 【Project】 DataPath.qpf in engineering, design top-level module 7. compilers to compile the results and see)
    2009-04-27 11:52:56下载
    积分:1
  • Multi_function
    01 线性调频信号的卷积功能测试(匹配) 02 LFM一维距离像 03 MATLAB联合FPGA仿真输入/输出功能测试 04 解速度模糊 05 扩展目标检测(01 LFM Test function of "conv" 02 LFM Range 03 MATLAB and FPGA 04 resovle speed resolution 05 Extended moving target)
    2013-05-03 15:53:43下载
    积分:1
  • simple_cpu
    初学cpu结构的很好的verilog代码的示例,适合初学者(novice cpu structure of the good verilog code examples for beginners)
    2007-03-03 01:05:16下载
    积分:1
  • VHDL数字系统设计工程实践,包含实验的原理,真值表和结构图描述,以及相关的VHDL代码。...
    VHDL数字系统设计工程实践,包含实验的原理,真值表和结构图描述,以及相关的VHDL代码。-VHDL digital system design engineering practice, including the principle of the experiment, truth table and chart descriptions, and associated VHDL code.
    2022-03-31 18:00:55下载
    积分:1
  • UART_prj_ViHDL
    vhdl project at sbu uni in iran uart
    2010-05-08 16:18:37下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载