基于System Generator的最大值求解

This is a divider, which is depicted as well. It is a programming language Vhdl.

直接序列扩频通信的Verilog仿真代码，在Quartus II中实现。(Direct sequence spread spectrum communication Verilog simulation code, implemented in Quartus II.)

Verilog 语言编写 PCI9054 控制器的接口电路，实现 PCI总线到本地 8 位总线的转接控制(The Verilog language writes the interface circuit of the PCI9054 controller to realize the transfer control of the PCI bus to the local 8 bit bus)

里德所罗门编码器和解码器都常用的在数据传输和存储的应用，如广播的设备、 无线局域网、 电缆调制解调器、 xDSL、 卫星通信、 微波网络和数字电视

对于32位寄存器前导零个数的计数，一个简单的程序(32 registers a leading zero number of counts, a simple procedure)

说明：  浙江大学计算机组成实验12指令扩展多周期CPU实现(The implementation of 12 instruction extended multi cycle CPU in Computer Composition Experiment of Zhejiang University)

学习verilog中常见的编程方法和例子。欢迎大家下载、试用。谢谢大家的支持！

这种电路将加载 （写） 的地址内的 RAM 和显示地址的数据序列。 在读期间，我们可以触发一个中断对数据进行排序升序和显示 5 次，并返回 回读状态。

资源描述详细的阅读了AHB协议规范，采用Verilog硬件描述语言，按照协议要求设计主机与从机。时序仿真通过。在压缩包里附有该设计的验证程序。

完整的GMSK调制及维特比译码，程序中包括了高斯滤波器的设计，调制相位的计算，并采用了维特比译码算法解调出原始码元，最后计算了其误码率。(Complete GMSK modulation and Viterbi decoding, the program includes a Gaussian filter design, the calculation of the phase modulation, and uses the Viterbi algorithm demodulates the source element, the final calculation of the bit error rate.)