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ECC密码体制采用Verilog

于 2023-05-26 发布 文件大小:20.37 kB
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代码说明:

这个程序是我用HDL语言Verilog为椭圆曲线加密开发的!希望所有的算法都包含在里面!欢迎留言!

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • rsa simple c#
    我们
    2023-06-25 18:45:02下载
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  • 本程序能产生大部份实用随机数:产生一个[0,1]区间内均匀分布伪随机数、产生多个[0,1]区间内均匀分布伪随机数、产生任意[a,b]区间内一个均匀分布伪随机整数...
    本程序能产生大部份实用随机数:产生一个[0,1]区间内均匀分布伪随机数、产生多个[0,1]区间内均匀分布伪随机数、产生任意[a,b]区间内一个均匀分布伪随机整数、产生任意[a,b]区间内均匀分布伪随机整数序列、产生一个任意均值与方差的正态分布随机数、产生任意均值与方差的正态分布随机数序列-look it yourself
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  • 编译原理 词分析器、语分析、语义分析和目标代码生成
    L语言编译器的设计与实现,词法分析最后产生token文件和符号表文件,然后进行语法分析和语义分析,采用的是递归下降方法,最后产生四元式,通过中间代码产生目标代码
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  • FPGA数字时钟 6.10.24进制计数器。
     错不了。。相信我。。是一个关于数字时钟需要用到的进制算法,我把他单独分开出来的模块。源码内容较为简单但是 缺 五脏俱全。原理是这样的,把时钟分为 秒模块,分模块,时模块。秒和分模块一样一起讲,以秒为例子。z秒是0-59那么有个位和十位,个位上数字是0-9,十位上是0-5.那么在秒十位上就是用十进制,在十位上用6进制。这样就可以实现秒个位到9的时候下一秒 向秒十位进1.当秒到59时候,下一秒向分的个位进1.一样的步骤实现分的进制算法。时的算法较为复杂,它分了两段来计时,在时的个位上记两次十进制,在加四的时候停止,重新从00 开始计时。时的算法解释的比较仓促,需要详情请联系我。
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