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故障时钟检测电路的设计

于 2023-04-02 发布 文件大小:952.22 kB
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代码说明:

采用延时锁相环设计时钟延时电路,然后通过比较时钟信号来判断时钟信号是否发生时毛刺。压缩文件是一个VIVADO2015.1写的工程,包括测试文件,verilog语言编写

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  • ecc verilog
    这是一个用verilog实现的ECC代码,里面有C文件用于功能验证
    2023-06-07 15:15:04下载
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    2020-12-19 17:09:10下载
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  • Traffic_RYG
    交通灯的控制,分主干道和从路交通灯,主路优先,正常情况下,绿灯60s,红灯30S,黄灯5S(Traffic light control)
    2020-06-21 06:40:02下载
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  • 发送卡
    led 发送卡代码(led send card verilog)
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    2011-08-07 20:23:10下载
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  • cn1
    在MATLAB的SIMULINK中,用DSPBUILDER实现计数功能,控制LED指示灯.(In MATLAB SIMULINK, DSPBUILDER is used to realize counting function and control LED indicator lamp.)
    2018-08-16 15:35:47下载
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  • 一个基于Verilog语言的简单处理器
         该程序为使用Verilog HDL语言设计的一个可以根据输入的指令完成不同的操作的简单处理器,可实现mv,mvi,add,sub四个汇编指令,并且使用Quartus II可对该程序进行仿真,最后下载至DE2开发板中可对处理器功能进行验证。
    2022-04-10 01:50:12下载
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  • FPGA按键加蜂鸣器实验
    FPGA按键加蜂鸣器实验: 加延时防抖+蜂鸣器(Experiments of keys and buzzers in FPGA)
    2020-06-22 04:00:01下载
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