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14个DSP的实验测试程序，汇编语言实现，类型分别为：滤波器，正弦波发生器，步进电机，直流电机，交通灯，语音录放，指令实验，存储器，串行口，定时器，显示屏，硬件中断，同步串口，exam-c。-Fourteen DSP testing programs,implemented by assemble language,types:filter,sine wave generator,Stepping motors,direct current motors,traffic light,voice play,instruction experiment,register,serial port,timer,display screen,hardware interrupt,synchronous serial port,exam-c.

感应电机汇编源程序,已经完全调试通过,方便使用TI公司2407DSP的同行应用,高手可用.是我的心血,小心应用.-induction motor compiled source files, debugger has been entirely passed, ease of use TI DSP 2,407 peer applications, experts available. I done, carefully applied.

ADSP-BF53x 处理器利用CPLD 的I/O 资源，扩展键盘的设计方法及程序设计的实例代码。附有试验文档。设备：DM-EDU-SSKBF53x 开发板一套（DM-KIT-CBBF53x 模块，DM-KIT-EXBSSK-BF5xx 模块)， DM-TOOLS-USBICE2.0 仿真器一套，4*4 键盘.-ADSP-BF53x processor using CPLD" s I/O resources to expand the keyboard design methods and programming code examples. With a test document. Equipment: DM-EDU-SSKBF53x development board set (DM-KIT-CBBF53x module, DM-KIT-EXBSSK-BF5xx module), DM-TOOLS-USBICE2.0 simulator set of 4* 4 keypad.

DSP c64优化 ACT spraa14 mp3优化实例 与其优化应用报告配套-DSP c64 optimization ACT spraa14 mp3 optimize optimize application examples of the report and its supporting

这是我编的FIR滤波器的dsp程序,可调成滤波器阶数,汇编语言编程,执行效率高,工程文件全,打开就可以使用.在TI的ccs上调试成功,用的同样是54系列的dsp.-This is my series of FIR filter dsp procedures, adjustable filter bands into a number of assembly language programming, the implementation of high efficiency, the whole project file, open you can use. In TI

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TMS320VC5509A 看门狗测试程序-TMS320VC5509A watchdog testing procedures

dm642视频口的驱动程序,采集和显示分别包括PAL,NTSC监视器和VGA显示器-dm642 Video of the driver, acquisition and display, respectively, including PAL, NTSC monitor and VGA Display

蓝牙模块的2/3FEC接口函数，在CCS环境下编译通过。-2/3FEC Bluetooth module interface function, the CCS environment compile.

在文献中已经报道了几种架构的内存为基础的实施数字信号处理器的算法，涉及正交变换和数字滤波器。乘法是在信号处理和ALU，乘法器主要运算采用查找表（LUT）作为其计算的记忆。然而，我们没有发现任何显着的工作记忆LUT优化乘法。提出了查找表的设计一种新的方法，其中只有奇数多存储（OMS）方案。此外，反对称的产品编码（APC）方法，LUT减小一半，提供了一种减少。当APC方法结合OMS技术，两补码运算可以简化由于输入地址和LUT的输出可以被转化为奇数，从而减少LUT尺寸四分之一的常规lut.the LUT乘法器提出字的大小= W = 5和6比特编码的Verilog和在Xilinx 13.4合成。研究发现，提出了基于LUT的乘数是同等面积的大小和时间复杂度为8位字，但较高的字的大小，它涉及比CSD地区少倍增时间明显减少（CSD）为基础的乘数。对于16位和32位字大小，分别提供超过节省面积延迟产品在相应的CSD乘数30%和50%。