apb2.0 语言

这是一个完整的工作模块编码在 verilog 检测的旋转车轮的旋转速度。它也给旋转的方向。这可以在 fpga 板直接实施，此模块内还有一个特别的小模块，以生成测试信号的面积。所以你不需要连接一个车轮与旋转编码器来测试 speedo 米。这就是独一无二的关于此模块 ！！！cheerz!! 享受

本人上网下载下来并调试过的，完全实现NIOS 点亮LCD_Panel，附件是驱动部分。

基于高清视频的3D人脸识别源代码，四万多行，经过FPGA实际验证，最近调试完毕。(The source code of 3D face recognition based on HD video, more than 40,000 lines, has been verified by the actual FPGA, and has been debugged recently.)

基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,基于视频的运动跟踪(System Generator based image processing engineering, multimedia processing on FPGA source, video-based motion tracking)

verilog HDL编写的浮点除法器，编译通过，可综合。压缩包包含三个文件。(verilog HDL write floating-point divider, compile, can be integrated. Archive contains three files.)

VCS详细学习资料。内涵专业研究院所内部培训资料。适合于初学者学习使用，易于上手。(VCS learning)

, verilog语言实现的高速DACAD9747的SPI接口及寄存器配置

RTL设计与VHDL代码；nbsp；VHDL代码RTL设计的VHDL代码RTL设计的VHDL代码RTL代码designvhdl designvhdl RTL代码RTL代码designvhdl designvhdl RTL代码designvhdl RTL设计RTL代码

说明：  高清电子书4本合集-Verilog HDL数字系统设计教程4本合集(Digital circuit design Verilog HDL digital system design)

使用 Virtex-4 FPGA 器件实现DDR SDRAM控制器 本应用指南描述了在 Virtex™-4 XC4VLX25 FF668 -10C 器件中实现的 DDR SDRAM 控制器。 该实现运用了直接时钟控制技术来实现数据采集，并采用自动校准电路来调整数据线上的延 迟。 DDR SDRAM 器件是低成本、高密度的存储资源，在很多存储器供应商处均可获得。本参考设 计使用 SDRAM 器件和 DIMM 开发而成