登录
首页 » VHDL » 程序在报告中,要 用QuartusII运行,注意从word到运行环境中,可能有个别符号不兼容,重新在运行环境中输入那些符号就可以了...

程序在报告中,要 用QuartusII运行,注意从word到运行环境中,可能有个别符号不兼容,重新在运行环境中输入那些符号就可以了...

于 2022-07-17 发布 文件大小:5.90 kB
0 137
下载积分: 2 下载次数: 1

代码说明:

程序在报告中,要 用QuartusII运行,注意从word到运行环境中,可能有个别符号不兼容,重新在运行环境中输入那些符号就可以了-procedures in the report, with QuartusII operations, the attention to word from the operating environment, Some individual symbols are not compatible, the operating environment to re-enter those symbols on the

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 介绍了基于Altera 公司的CPLD 芯片FL EX10 K,以及利用VHDL 语言实现多位二进 制码转换成8421BCD 码的原理、设计思路和软件实现。...
    介绍了基于Altera 公司的CPLD 芯片FL EX10 K,以及利用VHDL 语言实现多位二进 制码转换成8421BCD 码的原理、设计思路和软件实现。-Introduction based on Altera
    2022-02-16 07:54:31下载
    积分:1
  • ConvolutionWithViterbiDecoding
    QPSK调制下的(5,7)卷积码的编码和维特比译码与BPSK调制下(5,7)卷积码的编码和维特比译码的BER特性(QPSK modulation under (5,7) convolutional code encoding and Viterbi decoding and BPSK modulation (5,7) convolutional code encoding and Viterbi BER characteristic)
    2020-12-12 20:09:15下载
    积分:1
  • juanji
    FPGA的卷积编码小程序,VHDL描述,参数为2,1,7.(2,1,7 cov with VHDL.)
    2010-09-24 20:28:22下载
    积分:1
  • interpolation_shaping_filter
    内插成型滤波器的FPGA实现,可根据需要配置不同的内插倍数,Quarter II环境编译,可直接使用(Interpolation shaping filter FPGA, can be equipped with different interpolation factor, Quarter II compiler environment, can be used directly)
    2013-11-12 21:13:46下载
    积分:1
  • codic
    8级cordic 算法verilog (8 cordic algorithm verilog)
    2013-08-21 11:31:46下载
    积分:1
  • verilog for full_adder
    verilog for full_adder
    2022-06-28 14:23:05下载
    积分:1
  • NIOSIIREV5.0
    很好的学习FPGA嵌入式的资料!适合初学者和工程师参考!(Good learning FPGA embedded information! Suitable for beginners and engineers reference!)
    2013-08-10 17:24:50下载
    积分:1
  • 用VHDL语言设计分频器,主要是因为一些子
    使用VHDL进行分频器设计,主要是一些分频的东西,整数分频,小数分频,奇次分频和偶次分频-Divider using VHDL to design, mainly because some sub-band stuff, integer divider, fractional-N, odd and even sub-sub-sub-sub-band frequency
    2022-04-24 21:36:07下载
    积分:1
  • 11 阶FIR 数字滤波器,verolog描述,通过modelsim 6.0 仿真,Quartue综合...
    11 阶FIR 数字滤波器,verolog描述,通过modelsim 6.0 仿真,Quartue综合-11-order FIR digital filter, verolog description, modelsim 6.0 through simulation, Quartue integrated
    2022-10-31 17:45:02下载
    积分:1
  • CPU代码
    CPU代码-VHDL语言,实现了CPU的基本功能。-CPU code-VHDL language, the realization of the basic functions of the CPU.
    2022-02-02 11:14:11下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载