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DATA_Scramble
扰码器的FPGA实现,选择的扰码器规格为15位移位寄存器。(FPGA scrambler, scrambler specifications for a 15 bit shift register.)
- 2021-01-16 19:28:46下载
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Modelsim concise user manual is very suitable for novice to use
Modelsim简明使用手册,十分适合新手使用-Modelsim concise user manual is very suitable for novice to use
- 2022-06-17 19:46:19下载
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04_led_test
FPGA控制外边led,并实现跑马灯等多种效果,用户可以自行控制(FPGA control outside led)
- 2020-06-16 09:40:02下载
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VHDL语言100例详解
说明: VHDL语言100例详解。详细讲解了用VHDL语言进行数字电路和数字系统设计的知识。用100个实例,不仅进行基础的门电路设计,而且还有较为复杂的数字系统设计。这些实例可以直接被调用。(VHDL Elaborates on 100 cases. Detailed account of VHDL for digital circuits and digital systems design knowledge. With 100 examples, not only for infrastructure gate design, but also more complex digital system design. These examples can be called.)
- 2005-09-04 17:15:21下载
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counter2
spartan-3e fpga vhdl 实现的计数器 记满后点亮小灯(spartan-3e fpga vhdl counter to light led)
- 2012-04-23 16:38:30下载
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sram_sp_hse_8kx8
SRAM 8K*8 芯片存储器 芯片存储器 芯片存储器(SRAM 8K*8
Chip memory
Chip memory)
- 2018-08-26 18:50:04下载
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ds18b20
说明: ds18b20的Verilog程序,经测试验证可以使用。注意此版本为DALLS DS18B20而不是DS1820,注意加5K上拉电阻。(ds18b20 the Verilog process can be used to verify by testing. Note that this version rather than DALLS DS18B20 for DS1820, the attention of Canadian 5K pull-up resistor.)
- 2020-10-29 11:09:56下载
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脉动进位加法器
设计的结构是纹波进位加法器,但执行的操作是加法和减法,两种操作都是32位的,具体取决于控制信号。如果控制信号为“1”,则选择减法,然后选择“0”,然后选择加法
- 2022-02-02 17:58:16下载
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标准电视信号的同步生成程序,利用VHDL和原理图,利用Quartus综合...
标准电视信号的同步生成程序,利用VHDL和原理图,利用Quartus综合-Standard television signal to generate the synchronization procedures, the use of VHDL and schematic diagram, using Quartus integrated
- 2022-03-13 05:08:34下载
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ac97 codec fpga vertix5
;建立一个录音机,用于录制和播放8位数字音频样本。实现了一个低通FIR滤波器模块,可以用作抗混叠和重构滤波器。
- 2022-02-06 18:53:20下载
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