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subpixel motion architecture

于 2022-06-11 发布 文件大小:390.55 kB
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subpixel motion architecture

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    这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.-This is my verilog hdl language used to write floating-point multiplier, using a Radix-4 algorithm for the booth for part of the plot using the 5-2 and 3-2 compression compression, welcomed everyone pointing, also welcomed the U.S. put it into a pipeline to improve speed.
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    ACM的算法参考书,涉及最短路径、最小生成树、网络流、可行遍性问题等-ACM Algorithm Book
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