登录
首页 » Verilog » Verilog 贪吃蛇

Verilog 贪吃蛇

于 2022-05-07 发布 文件大小:905.13 kB
0 157
下载积分: 2 下载次数: 1

代码说明:

对于重点:蛇身控制算法,我开始的想法是将每个格子的坐标输入到存储器中,但由于过于繁琐和笨拙,我改为:保留头部的完整数据(位置、方向),其他部分只保留方向数据,并在VGA模块里面直接对蛇身进行控制,但是这个方案有一个弊端:它按照蛇身顺序刷新图像,每一帧图像只能刷新一个格子,时序存在问题并且刷新频率过慢,放弃了这个方案。 最终,将蛇身模块单独提出,各个模块协同工作,有效解决了时序问题和刷新问题。蛇身控制上,只控制蛇头,其他部位随头联动,完成了最终设计。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • dianyuan
    实现按键控制AD三通道的电源转换的功能。(AD three buttons control channel to achieve power conversion)
    2015-04-23 16:20:49下载
    积分:1
  • Verilog code gen
    根据配置生成verilog module 可用于生成模块顶层接口,寄存器接口; 集成若干个模块; 生成模块简单testbench;
    2022-10-30 07:25:03下载
    积分:1
  • UC1608-24064
    UC1608 24064驱动 COG LCD驱动程序(UC1608 24064)
    2011-09-09 08:24:24下载
    积分:1
  • e1framerdeframer
    E1成帧器和解帧器的FPGA实现源码,测试可用(E1 Framer deframer)
    2012-12-07 12:10:06下载
    积分:1
  • exp12
    说明:  浙江大学计算机组成实验12指令扩展多周期CPU实现(The implementation of 12 instruction extended multi cycle CPU in Computer Composition Experiment of Zhejiang University)
    2020-10-09 16:17:35下载
    积分:1
  • Altera_lcd_color_bar_117
    altera公司飓风四代芯片,LCD屏幕彩条显示,有效实现行、场扫描。练习FPGA驱动VGA或LCD显示的入门程序(Altera hurricane four generation chip, LCD screen color display, the effective realization of line and field scanning.Practice FPGA to drive VGA or LCD display)
    2017-12-18 11:23:10下载
    积分:1
  • S03_基于ZYNQ的DMA与VDMA的应用开发
    VIVADO dma以及vdma 使用文档 基于ZYNQ 7020(vivado DMA&VDMA example text of zynq)
    2020-06-17 11:40:02下载
    积分:1
  • cpu110
    基本功能的cpu,自定义内存内容~了解CPU运作原理~(design of cpu,VHDL environment~)
    2016-04-25 10:13:26下载
    积分:1
  • dpd_v6_0_example_design
    xilink DPD V6.0 IP Core design example
    2014-03-01 10:26:47下载
    积分:1
  • ahb_sram
    ahbsram contains all codes of sram
    2019-04-27 21:25:52下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载