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CGRA加密算法可重构
工作机制如下:
1、 系统上电,配置信息由片外加载到片上配置存储器中;
2、 执行某算法前,将此算法所有的配置包写入到配置包存储器中(配置包存储器包含在配置解析单元中);
3、 配置解析单元解析配置索引,从配置存储器中选择相应的配置对可重构阵列及功能模块进行配置;
4、 阵列从外部中读取数据进行计算,计算结果写出到密文寄存器中;
5、 可重构阵列与功能模块计算的中间结果数据只与通用寄存器堆进行交互;
6、 阵列计算的中间结果通过通用寄存器堆缓存;
- 2023-05-25 10:10:04下载
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manuals
ISE Design Suite Software Manuals and
Help - PDF Collection,ISE 软件手册以及帮助。(ISE Design Suite Software Manuals and Help- PDF Collection, ISE software manuals as well as help.)
- 2012-11-28 21:47:01下载
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简易cpu的设计
计算机组成原理的课程设计作业,用vhdl语言写了一个简易的cpu,包括寄存器,存储器等原件,完全用代码写成,没有直接用原件去连接,有助于我们很好的学习vhdl。 这是一个cpu的连接代码,并没有各种原件的代码 ,因为各个原件代码很简单就没上传
- 2022-03-12 07:35:18下载
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edashuzipinlvji
EDA/VHDL数字频率计,可编程逻辑门阵列,EDA课程设计(EDA/VHDL digital frequency meter, programmable logic gate array, EDA curriculum design)
- 2013-04-16 17:00:58下载
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Verilog-shift-mulfunction
FPGA verilog 实现任意位宽的移位相乘法,有符号小数或者有符号整数相乘。函数调用方式(FPGA verilog achieve any bit-wide shift multiplication , signed or signed decimal integer multiplication . Function call
)
- 2014-06-21 17:08:12下载
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14_SDRAM
说明: 高速流水的SDRAM控制器,最高速度可达速度在200M左右(high speed SDRAM controller)
- 2019-06-17 18:43:54下载
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LDPC_DVB-T2
LDPC encoding code in 1/2code rate for DVB-T2
- 2014-03-11 08:05:18下载
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UC1608-24064
UC1608 24064驱动 COG LCD驱动程序(UC1608 24064)
- 2011-09-09 08:24:24下载
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arm7
ARM7 VERILOG源码,非常精简,3级流水线(ARM7 VERILOG source code, very streamlined, 3-stage pipeline)
- 2009-12-02 10:57:51下载
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FPGA
基于FPGA设计ADC0809采样控制器原代码-FPGA-based design ADC0809 Sampling Controller source
- 2022-05-30 01:45:47下载
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