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中山大学计组实验--单周期CPU设计

于 2022-03-21 发布 文件大小:1.76 MB
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代码说明:

中山大学计组实验--单周期CPU设计,实现12条指令,基于xilinx ISE 14.4 测试通过

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • Poorscope
    poor scope is a vhdl implimentation pic micro controller
    2013-02-02 13:01:17下载
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  • 玩转LVDS_USB
    说明:  verilog 版本,Xilinx玩转USB3.0,LVDS接口(verilog version,Xilinxplay with USB3.0,LVDS)
    2021-01-01 16:01:57下载
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  • FDMA
    实现FDMA的仿真,3路输入信号,FFT输出(FDMA simulation input signal, FFT output)
    2020-11-12 20:49:43下载
    积分:1
  • 3路由器的设计与验证
    应用背景这是一个内部的以太网路由器数字系统的源代码。代码已经编写的Verilog使用行为模型。有3个奴隶,一个主人,这就是为什么它被称为3配置。关键技术主要的RTL已使用Xilinx ISE仿真。FPGA实现了FPGA做sparten家庭。alhou ASIC实现,可以使用任何标准的工具如概要等。
    2022-02-06 03:03:45下载
    积分:1
  • SPI_slave代码,已经实用!
    SPI_slave代码,地址长度可设1~3字节,时钟可以运行到20MHz以上,已经在项目里使用,有需要的可以再根据自己的要求修改!!!!
    2022-10-15 13:00:02下载
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  • encode_64_66
    自编的64B/66B编码程序,下次上传解码程序。(the 64B/66B coding process is written by myself, i will upload the decoding process next time.)
    2011-08-27 10:38:53下载
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  • FPGA 蜂鸣器
      1.     蜂鸣器实验 (1)    频率设定 音乐来自震动,为了区别音调,需要有不同的震动频率。制作一个最底层的变频器,依据传入的分频值从100MHZ分频至相应音调的震动频率,将这一震荡信号接到蜂鸣器。 为了标志低中高
    2022-02-13 05:59:25下载
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  • hdlc
    hdlc协议的封装与解析,fsc校验,完整的例程代码(Decode and Encode an HDLC packet ,using FCS16 calculation)
    2015-09-21 11:20:55下载
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  • half_adrrrrder
    FPGA上的一个半加器实例程序,通过测试,可以直接运行在fpga开发板上。(One and a half adder example on FPGA program, through the test, can be run directly on the FPGA development board)
    2013-12-01 12:01:31下载
    积分:1
  • LCD1602
    这是一个LCD1602底层驱动代码,TI公司LM3S系列的(This is a LCD1602 underlying driver code, TI company LM3S series)
    2013-10-30 16:40:45下载
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