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Verilog&Vhdl混语言对SDRAM的控制源代码,提供了很好的例子,顶层文件为sdrm.v!...

于 2022-03-18 发布 文件大小:244.23 kB
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代码说明:

Verilog&Vhdl混语言对SDRAM的控制源代码,提供了很好的例子,顶层文件为sdrm.v!-VerilogVhdl mixed language SDRAM control of the source code, provided a good example of top-level documents sdrm.v!

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    vhdl语言和verilog语言转换工具 能很容易的实现两种语言的相互转换-verilog language vhdl language and conversion tools can easily achieve the conversion between two languages
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  • generate-coordinates
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    2013-08-28 11:03:46下载
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  • decodeLogDomainSimple
    When the initial input falls between the Switch off point and Switch on point values, the initial output is the value when the relay is off.
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  • fft
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    2013-10-12 17:21:32下载
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  • Arinc429
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  • shuzifujieqi
    主要给出准循环的LDPC码编码实现方法,译码方法选择,并给出了帧同步的解决方法(Give the main quasi-cyclic LDPC codes achieve coding method, decoding method of selection, and give the frame synchronization solution)
    2009-03-14 17:22:33下载
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    利用VHDL实现CPLD(EPM240T100C5)的串口接收程序-Using VHDL realize CPLD (EPM240T100C5) the serial receive procedure
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  • lanqiu24s8
    篮球24s计时。计时器递减计数到零时,数码显示器显示‘0’并停止,同时发出报警信号(basketball 24 seconds)
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