登录
首页 » Verilog » 串口verilog实现

串口verilog实现

于 2022-03-07 发布 文件大小:3.53 kB
0 181
下载积分: 2 下载次数: 1

代码说明:

    此程序完成的是接收上位机发送的多字节串口数据的工作,并把不同的字节分配给不同的寄存器,以完成相应的控制工作。因此有必要说明一下上位机发送的数据结构。    上位机通过串口给FPGA发送两组信号,每一组发送5个字节(可根据自己的实际需要修改),不同字节控制不同的功能。     第一组是根据选择的波形、填写的频率以及选择输出信号的时域还是频域,给FPGA发送不同的参数。点击发送数据按钮后一共发送5个字节的数据。第一个字节发送监测信号,设为0x00,标识发送的是波形设置的数据;第二个字节发送的是进行波形选择的信号;第三和第四个字节发送的是波形频率的低8位数据和高8位数据;最后一个字节发送的是选择输出是时域还是频域的信号。     第二组是根据填写的频率给FPGA发送不同的参数。点击开始滤波按钮后一共发送5个字节的数据。第一个字节发送监测信号,设为0x01,标识发送的是滤波器设置的数据;第二和第三个字节发送的是频率1的低8位和高8位数据;第四和第五个字节发送的是频率2的低8位和高8位数据。     所以本程序中rs_receive模块接收数据部分需按照串口发送的数据格式进行接收:(这部分应根据自己的实际需要设计)     当接收到的第一个字节是0时,下面接收的数据都是波形设置信号。当接收到的第一个字节是1时,下面接收的数据都是滤波器的输入波形设置数据。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • stm8uart
    Demo program for use UART STM8S
    2013-09-05 03:18:35下载
    积分:1
  • nco11000
    实现输入一正弦波和噪声的叠加,介绍详细欢迎下载(The input of a superposition of sine wave and noise introduced in detail)
    2010-05-16 14:19:53下载
    积分:1
  • Sdram 控制器
    在 verilog 代码 sdram 控制器. 在 first.rar-- matlab 代码是在 first.rar 为接收器分布给出了在 MATLAB 文件 clockTreeAssignment.m 中找到零偏差时钟直线树。 发现从根源到汇的延迟 (时钟延迟)。使用埃尔莫尔延迟-model(i.e no need to do SPICE simulation) 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报
    2022-07-04 18:19:05下载
    积分:1
  • dianzhen
    如果需要用verilog设计一项比较简单的功能,那么这个浅显易懂的程序能让你很快明白点阵的设计方法,尤其是对那些初学者(If you need to use a relatively simple verilog design features, then this easy to understand design of the program allows you to quickly understand the lattice method, especially for those who are beginners)
    2014-01-16 16:13:53下载
    积分:1
  • imports
    displayport 参考设计,可以对比自己工程做验证,另有参考设计XAPP1178未找到,采用方案为DP159 + Artix7 FPGA(xilinx displayport sink design)
    2021-01-11 16:58:50下载
    积分:1
  • EC-67-XT_en
    LED based video wall tech spec
    2012-12-20 20:27:37下载
    积分:1
  • clk
    sin波形发生图形,应用智能老师款到即发了快速打击 (sin waveform generation graphics application smart teacher paragraph to that made a rapid strike)
    2013-02-24 15:46:58下载
    积分:1
  • axi_master
    DDR3 控制器,axi4_full 模式, burst长度为16,应用于xilinx平台。(DDR3 interface controller, axi4_full working mode with burst length 16, can operate on the xilinx platform.)
    2017-05-16 11:26:28下载
    积分:1
  • Masseffect-3---Jane-Shepard
    超級好用 25M~100HZ的除頻器 寫了好久 超級實用 歡迎下載(Super easy to 25M ~ 100HZ of divider wrote a long time super practical welcome to download)
    2013-09-13 13:33:13下载
    积分:1
  • CCDDRIVE(TCD1206UD)
    关于一款线阵CCD TCD1206UD 的驱动设计,波形符合工作要求(On how the system in SOPC using HDL language development from a custom IP core)
    2020-11-14 09:19:42下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载