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aderr 约 4 位

于 2022-03-05 发布 文件大小:480.46 kB
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该文件.RAR它有关的4加法proyect - 位这proyect使用,以12和4列,为您proyect。

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  • 74HC161
    74ls161 基于verilog语言的实现 源程序在压缩包的hdl文件夹中(74ls161 language based on the realization of verilog source package in compressed folder hdl)
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  • 中值算法
    在FPGA上实现的图像处理中值算法,其中包含对输入数据的控制,内容详细,如果需要复杂的 图像滤波算法只需要修改中值模块即可。在altera上可用,如果要再xilinx上使用,只需要将fifo替换即可
    2022-01-25 13:58:00下载
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  • wishbone
    wishbone接口的设计,在交换机和MAC之间建立wishbone接口(the wishbone interface design, wishbone interface between the switch and MAC)
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  • MIPSTOP
    说明:  misp顶层文件,verilog实现misp架构,并且支持modelsim仿真(Verilog implements MISP architecture and supports Modelsim simulation)
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  • QDPSKvhd
    说明:  基于quartusII的QDPSK调制解调vhdl程序。(Modulation and demodulation based quartusII of QDPSK vhdl program.)
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  • fpga通过usb 向电脑发送计数器的数据
    fpga通过usb 向电脑发送计数器的数据  程序亲测可用
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  • ahb_sramc_svtb
    ahb总线Verilog代码及sv仿真文件(ahb bus Verilog code and sv simulation code)
    2021-05-14 14:30:02下载
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  • bt656p
    说明:  BT656 时序, 逐行, 分辨率1280*960@25Hz(BT656 time series, row by row, resolution 1280*960@25Hz)
    2020-12-09 12:09:19下载
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  • dct
    基于FPGA的图像压缩算法程序,自己写的,可以参考一下(FPGA-based image compression algorithm, write your own, you can refer to)
    2011-10-23 00:54:17下载
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