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VHDL FPGA 流水灯实验

于 2022-03-05 发布 文件大小:632.95 kB
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应用背景流水灯实验,FPGA基础   设计流程   程序下载   流水灯实验,FPGA基础   设计流程   程序下载流水灯实验,FPGA基础   设计流程   程序下载流水灯实验,FPGA基础   设计流程   程序下载流水灯实验,FPGA基础   设计流程   程序下载流水灯实验,FPGA基础   设计流程   程序下载流水灯实验,FPGA基础   设计流程   程序下载流水灯实验,FPGA基础   设计流程   程序下载关键技术VHDL   基本语法   设计思想   FPGA基础实例   VHDL   基本语法   设计思想   FPGA基础实例VHDL   基本语法   设计思想   FPGA基础实例VHDL   基本语法   设计思想   FPGA基础实例VHDL   基本语法   设计思想   FPGA基础实例VHDL   基本语法   设计思想   FPGA基础实例

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  • 4ADlcd
    单片机4路ad模数转换数码管动态显示程序(4-way ad microcontroller analog to digital conversion digital tube dynamic display program)
    2013-06-02 22:10:07下载
    积分:1
  • mancheshitebianjiema
    用VHDL编写的曼切斯特编解码,适用于以太网上流行的基带传输数字编码。(Manchester encoding and decoding written using VHDL, popular Ethernet baseband transmission of digital coding.)
    2012-05-25 15:16:35下载
    积分:1
  • xiaomi
    新版 小米抢购器 -源码 已经测试,代码很有用,已经抢了好几个小米3了,希望对大家有用(The new millet to snap up- source Have test, the code is useful, has robbed several millet 3, hope useful for everyone)
    2014-01-08 18:26:40下载
    积分:1
  • 非常多的verilog实例,对于刚入门者比较有用
    非常多的verilog实例,对于刚入门者比较有用-lot of verilog example, just beginners more useful
    2022-03-17 16:05:10下载
    积分:1
  • 4X4keypad shake the module, the keys for false detection
    4X4keypad的防抖动模块,用于假按键的检测-4X4keypad shake the module, the keys for false detection
    2023-07-04 10:00:03下载
    积分:1
  • traffic_lights
    用Verilog实现的交通信号灯控制,主干道和支路通行的时间不相等(Using Verilog implementation of traffic signal control, the trunk road and the slip is not the same passage of time)
    2009-03-28 18:31:31下载
    积分:1
  • FPGA_trainning2013A
    在EDA实验课上面,自己编写的NCO程序,可以产生出比较真实的正弦波、三角波以及锯齿波,用VHDL程序编写,有modelsim仿真textbench程序(On EDA experiment, oneself write the NCO program, can produce more real sine wave, triangular wave and sawtooth wave with VHDL programming, have the modelsim simulation textbench program )
    2013-07-16 15:05:28下载
    积分:1
  • 06219426Spartan3E
    VHDL汇编语言原理及源代码。spartan 3e开发板试用。(VHDL language.)
    2011-02-10 09:41:12下载
    积分:1
  • UART_RX_
    fpga串口的发送程序基于verilog语言拿走不用谢。(The sending program of FPGA serial port is based on Verilog language.)
    2020-06-18 04:00:01下载
    积分:1
  • 这是一个时钟的VHDL源代码,其中包含了源代码,以及工程。
    这是一个时钟的VHDL的源程序,里面包含有源程序,还有工程文件对大家很有帮助-This is a clock VHDL source code, which contains the source code, as well as engineering documents helpful to everyone
    2023-03-26 14:20:04下载
    积分:1
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