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基于Verilog HDL的单周期CPU设计
基于Verilog HDL 的单周期CPU设计。基于Verilog HDL 的单周期CPU设计。基于Verilog HDL 的单周期CPU设计。基于Verilog HDL 的单周期CPU设计。cpp码
- 2022-03-25 17:33:14下载
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cf_interleaver2
interleaver即交织器,里面包含有C,VHDL,VRILOG HDL三种语言写的交织器, 包括各种各样的组合达六七十种,描写详尽,是一个难得的学习交织器的材料 -interleaver that interleaver, which contains C, VHDL, VRILOG HDL three languages to write the interleaver, including a variety of combinations to depend species, a detailed description, is a rare study of the materials are intertwined
- 2022-03-16 02:30:32下载
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20190717 - Copy
说明: this describes building spi block on verilog hdl and programming them on an fpga device
- 2020-06-21 21:40:02下载
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codelock
说明: 用VHDL实现密码锁功能,用状态机实现,分管理员和用户两种功能,可分别修改密码,重置密码等。(codelock,VHDL,state)
- 2010-03-19 13:32:14下载
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FPGA
Verilog 我认为写的非常好的细节书(Verilog In my opinion written details of the book)
- 2012-10-03 10:10:46下载
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vhdl
code for fft non synthesisable in xilinx ise
- 2013-09-30 13:16:13下载
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FPGA的DDS发生器
以DE2为开发平台,采用Veriolg语言编程,实现了DDS信号输出,频率,步进,波形输出均可调,采用Modelsim以及FPGA内嵌逻辑分析仪验证设计的正确性,可以满足一定的工程需求。
- 2022-06-16 12:56:09下载
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H.264 Verilog Decoder
nova是一个低功耗的H.264/AVC基线解码器,面向移动应用。它是一种专用的、全硬连线的ASIC设计,不使用任何GPP/DSP核
- 2022-09-21 08:50:03下载
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SPI_Master
此代码是SPI接口的Master的Verilog源代码,经上板测试是没有问题的,请大家放心使用
(This code SPI Interface Master of Verilog source code, there is no problem on board test, please rest assured to use)
- 2021-02-25 09:19:38下载
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RISC-V-Reader-Chinese-v2p1
说明: RISC-V 芯片设计规范,很有参考价值,开源芯片设计必备参考资料,希望对大家有帮助。(The RISC-V Foundation is chartered to standardize and promote the open RISC-V instruction set architecture)
- 2020-07-01 23:00:02下载
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