veriloge计算

利用fpga实现gmsk的调制并仿真，全部代码(Fpga implements gmsk)

就是生成原始波形数据，设计Verilog代码，把数据加载到初始ram中，再调用数据进行仿真，仿真实现波形还原，和进行合成之类。

this is verilog code for designing ALU in fpga.

这个代码是USB的控制代码，可实现USB的发送与接收数据功能。里面有4个文件，新建一个工程即可编译运行。

128 位 aesverilog 代码 对于很多核心处理器阵列平行 aes 引擎

Verilog经典教程，很好的学习Verilog的书籍，对学习硬件编程很有帮助。(Verilog classic handbook, good learning Verilog books, to learn hardware programming helpful.)

本设计是设计了一个4位全加器的内容，是由4个一位全加器串联而成的(The design is to design a full adder 4 content, is one of four full adder in series from the)

几大代工厂的flash verilog源代码(flash verilog code)

同步fifo的调用程序，调用Quartus II 9.0 (32-Bit)中的fifo模块(Synchronous fifo calling program, call Quartus II 9.0 (32-Bit) in fifo module)

PCS和PMA都包含在OSI参考模型的物理层内。PCS和千兆媒体独立接口（GMII）彼此经由8位并行数据线和多个控制线进行通信。PCS负责编码传下来的GMII到10位码组每个字节。PCS还负责解码向上传递从PMA成八位位组中使用由上层10位码组。PCS还控制自动协商过程中，允许两个独立的千兆设备，建立其中一个链接他们都能够使用。