登录
首页 » VHDL » verilog 232串口收发程序 在开发板上测试成功过

verilog 232串口收发程序 在开发板上测试成功过

于 2022-02-11 发布 文件大小:585.90 kB
0 141
下载积分: 2 下载次数: 1

代码说明:

verilog 232串口收发程序 在开发板上测试成功过-verilog 232 serial port transceiver program already had some success in the development of on-board test ^ ^

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 8B10B
    以太网PHY层中的组成部分 8B10B编码器(Part of the Ethernet PHY layer in 8B10B encoder )
    2021-01-27 09:18:42下载
    积分:1
  • wbm
    用walsh算法实现的符号数乘法器,asic流片时,可以不用公司的付费乘法器的ip core.(algorithm using the symbols multiplier, HDL-piece quantities. it is not necessary for the company's paid Multiplier ip core.)
    2006-07-12 14:49:35下载
    积分:1
  • 基于FPGA五子棋显示verilog源代码
    基于FPGA的verilog语言描述五子棋游戏中的棋框显示,应用VGA显示原理,用不同的颜色显示边框。以及根据棋子输入的要求,显示相应的棋子,不同的颜色显示不同的棋框和棋子
    2022-12-19 10:35:03下载
    积分:1
  • 花了两周我们已经做出了一些改变,Altera DE1,DE2 PS2的IP
    花了半个月才改好的Atera DE1/DE2 ps2 IP 驱动核。放在FPGA工程目录下可以直接使用。本IP能够驱动PS/2键盘和鼠标。使用时只要调用HAL目录下的文件即可以直接使用!-Spent a good two weeks we have made some changes Atera DE1/DE2 ps2 IP-driven nuclear. On the FPGA project directory can be used directly. The IP to drive PS/2 keyboard and mouse. When used as long as the call HAL directory file that can be used directly!
    2023-07-13 20:25:03下载
    积分:1
  • K9HCG08U1D K9PDG08U5D K9LBG08U0D K9MDG08U5D 三星 4G 8G 16G nand资料
    K9HCG08U1D K9PDG08U5D K9LBG08U0D K9MDG08U5D 三星 4G 8G 16G nand资料-K9HCG08U1D K9PDG08U5D K9LBG08U0D K9MDG08U5D Samsung 4G 8G 16G nand datasheet
    2022-01-28 16:21:35下载
    积分:1
  • FPGA-powe-analysis-tool-EPE
    FPGA功耗分析工具EPE用于分析FPGA系统的功耗(FPGA power analysis tools EPE is used to analyze the power consumption of the FPGA system)
    2012-11-19 17:08:00下载
    积分:1
  • vhdl语言描述分频器,实现2、4、8、16……分频,经过实践
    vhdl语言描述分频器,实现2、4、8、16……分频,经过实践-description language VHDL divider, 2,4,8,16 ... ... realize frequency, through the practice of
    2022-10-30 11:40:03下载
    积分:1
  • RAD4FFTaRAD4iFFT
    基4的FFT正变换和反变换程序,速度特快,使用方法简单且在程序注解中标注。带有测试程序,且在多个项目中应用,正确性毋容置疑。(Rad4FFT 和 Rad4iFFT)
    2020-12-19 12:19:10下载
    积分:1
  • USB 1.1 IP
    USB 1.1 IP-CORE和设计范例 VHDL源代码-Sample program for USB1.1 IP core design, VHDL source code
    2022-05-24 18:47:17下载
    积分:1
  • AD_100k
    说明:  ADC Reference code!Clock 100kHz
    2020-06-24 10:40:02下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载