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basys3_timing
基于Basys3的数字钟实例,主要用于Basys3、vivado开发环境入门。源码使用VerilogHDL(Based on digital clock instance Basys3, mainly for Basys3, vivado development environment started. Use Code VerilogHDL)
- 2016-03-06 11:08:18下载
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华为内部的FPGA设计培训教程,详细阐述了设计流程图、Verilog HDL设计、逻辑仿真、逻辑综合。对大家的学习一定有帮助的。...
华为内部的FPGA设计培训教程,详细阐述了设计流程图、Verilog HDL设计、逻辑仿真、逻辑综合。对大家的学习一定有帮助的。-Huawei within the FPGA design training tutorial, a detailed flow chart of the design, Verilog HDL design, logic simulation, logic synthesis. Study of the U.S. must have help.
- 2023-05-11 10:40:03下载
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ALOHA
this program is a simulation for Aloha
- 2012-11-13 11:38:10下载
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步进电机位置系统
步进电机位置系统block symbol file
步进电机位置系统的Verilog HDL程序设计
已编译通过
步进电机位置系统
步进电机位置系统block symbol file
步进电机位置系统的Verilog HDL程序设计
已编译通过-Stepper motor stepper motor position location system system block symbol file location stepper motor system Verilog HDL program design has been compiled through
- 2022-04-25 13:54:32下载
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VHDL编写的flash控制器源代码.包含testbench。
VHDL编写的flash控制器源代码.包含testbench。-Prepared by flash controller VHDL source code. Contains testbench.
- 2022-03-18 10:11:40下载
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本文提供了一个CMOS控制器,使Nios II可以利用C.
本文提供了一种CMOS控制器,使Nios-II可以利用CMOS控制器控制CMOS,并允许在CMOS图像上传送SDRAM。在DE2-70平台上运行
- 2022-02-12 08:29:38下载
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generate-white-noise-with-fpga
一共7篇文章,介绍了使用fpga产生任意分布白噪声的方法,值得借鉴(A total of seven articles, describes using fpga to generate arbitrary distribution of white noise, it is worth learning)
- 2012-12-21 16:41:35下载
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SPI_UVM_VIP
说明: SPI协议的芯片验证VIP,用UVM搭建平台验证代码(Chip verification VIP of SPI protocol, build platform verification code with UVM)
- 2020-08-25 09:58:15下载
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VGA
本科毕业设计,简易逻辑分析仪,重点在于用CPLD搭建显卡,输出VGA信号驱动显示器显示逻辑波形(A design for LA,use cpld to generate VGA signals.)
- 2014-04-28 11:22:01下载
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RAYLEIGH
matlab 编的瑞利信道仿真源码,对研究信道很有用(hgajdjkjhakhdkhakjlkjlka)
- 2010-01-17 20:47:43下载
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