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My-Simple-Specturm--Analyzer
基于LabVIEW FPGA的频谱估计与分析(the power spectrum estimation and analysis based on LabVIEW FPGA)
- 2013-11-13 08:45:40下载
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CPU
用Verilog实现的 哈佛结构的简单指令集CPU程序,由ALU、地址译码器、指令译码器等部分组成(Part of a simple instruction Verilog realize the Harvard architecture CPU program set by the ALU, address decoder, an instruction decoder, etc.)
- 2016-05-22 10:07:29下载
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67_ellipf
vhdl very good debug release vhdl very good debug release
- 2006-10-22 18:39:48下载
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CV_FPGA_to_HPS_Bridge_Design_Example
FPGA通过AXI总线传输数据给ARM,ARM使用DMA方式接收数据!(FPGA to ARM Bridge design example)
- 2020-12-01 20:49:25下载
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用Verilog实现的八位存储器参考代码
我们按照应用的需求来定义计算机,本文介绍一个非常简单的CPU的设计,它仅仅用来教学使用的。我们规定它可以存取的存储器为64byte,其中1byte=8bits。所以这个CPU就有6位的地址线A[5:0],和8位的数据线D[7:0]。
我们仅定义一个通用寄存器AC(8bits寄存器),它仅仅执行4条指令如下:
Instruction
Instruction Code
Operation
ADD
00AAAAAA
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- 2022-04-28 07:03:19下载
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5_lcd_ST7565P_12864
液晶ST7565P_12864驱动,实现打点成图。(LCD ST7565P_12864 drive, dot mapping.)
- 2012-04-04 20:01:42下载
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的维特比编码器和解码器的VLSI实现
应用背景前向纠错技术的利用在接收端的错误更正。这是众所周知的数据在无线信道的传输受衰减,失真干扰和噪声,从而影响接收机的接收能力信息。维特比编码和Viterbi译码是一个功能强大的方法正向错误检测和校正。它已被广泛部署在许多无线通信系统,以提高有限容量的沟通渠道。本文的主要目的是描述比较分析各种FPGA器件之间的资源优化设计维特比编码器和解码器的实现。比较的基础是仿真和综合结果。在这个项目中,资源优化的Viterbi解码器的设计采用了追溯架构;关键技术Verilog是一个主要的硬件描述语言(HDL)用在工业界和学术界的verilog硬件设计师非常类似C和电气和计算机工程师最喜欢学习C大学语文。介绍了用Verilog 1985网关系统设计现在公司,Cadence设计系统公司的系统部的一部分。直到5月,1990,用Verilog开放国际的形成(OVI),Verilog HDL是一个专有的语言节奏。Cadence的动机是打开语言的公共领域的期望,市场对Verilog HDL相关软件产品将增长更迅速,更广泛的接受语言。抑扬顿挫,Verilog HDL实现用户需要的其他软件和服务企业要接受语言和发展Verilog设计工具支持。
- 2023-06-19 12:00:02下载
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Labview-Data-acquisition-card-
基于labview的数据采集系统,包括示波器和函数信号发生器,可以实现简单数据采集.(Labview-based data acquisition system, including oscilloscopes and function signal generator, can achieve a simple data acquisition.)
- 2014-01-15 21:26:04下载
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Verilog模块的缓存设计
这是 ;一种缓存设计的Verilog代码,使用先进先出算法。大约2000行代码,该程序包含缓存替换算法的实现。图像规则的选择,以及所有的模拟。这个设计有很多模块。这是缓存的主要模块。
- 2022-06-27 15:58:24下载
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XUAN-ZHUAN-led
旋转LED 实现自适应转速 字幕滚动 对接的程序(Rotating LED Adaptive Speed subtitles scroll docking program)
- 2013-02-06 16:17:56下载
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