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全加器及其仿真

于 2022-01-24 发布 文件大小:78.31 kB
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代码说明:

该段代码是verilog HDL 代码,为一个全加器,里面已经将其有源代码,及其仿真的效果,波形等等。可以用quartus II打开,或者进行下载到FPGA开发板上去。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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