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应用背景本文提出了一种技术自主设计和仿真的改进的体系结构进位保存加法器。这种体系结构被证明产生的结果，除了快速和需要的最低数量的逻辑大门。二进制加法是由一系列的异或运算进行，和移位左操作。这些操作被终止与完成信号表明了加法的结果。因为移位运算的数目进行的变化从0到n的n个加数，行为模型中的所有可能有2到15位加数的应用。推导了数学模型从数据和用于预测标准二进制的移位所需的平均数数字，如32，64或128位。4原型这个加法器的设计与仿真在同步和异步模式的操作。并；关键技术进位加法器，同步加法器，异步加法器

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